当我使用标准延迟格式输出文件(.sdo)参考注释掉的Verilog输出文件(.vo)文件时,为什么ModelSim软件中的功能仿真不匹配我的后综合仿真?-Altera-Intel社区-FPGA CPLD-ChipDebug

当我使用标准延迟格式输出文件(.sdo)参考注释掉的Verilog输出文件(.vo)文件时,为什么ModelSim软件中的功能仿真不匹配我的后综合仿真?

要使用.vo文件执行功能仿真,必须先将其包含的引用注释掉.sdo文件。您还应该强制ModelSim软件在编译atoms文件时使用delay_mode_zero选项忽略结构延迟。例如,如果您要定位APEX 20KE器件,请在ModelSim提示符处使用以下命令:

vlog +delay_mode_zero apex20ke_atoms.v

请登录后发表评论

    没有回复内容