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Lattice-莱迪斯-ChipDebug

Lattice-莱迪斯

帖子 1894互动 1088关注 37

莱迪思半导体公司是美国的一家半导体公司，专门从事低功耗，现场可编程门阵列的设计和制造。

Lattice-莱迪斯-ChipDebug

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8年前发布47次阅读

Synplify中的SAFE属性是什么？

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8年前发布47次阅读

当我设计的IO缓冲区为3.3V型时，为什么格子软件选择VCCIO组电压小于3.3V？

当将IO缓冲区滞后属性设置为NA时，可能发生上述情况。您可以使用以下三种方法中的一种来设置IO缓冲区RISISISIS属性：ISPLIFEN软件：从进程窗口开始设计设计器目标。选择视图-gt；电子表格视图。从SpReSueHET视图工具中选择端口属性选项卡。格子菱形软件：选择...

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8年前发布47次阅读

如何在没有合成错误的情况下为模块分配延迟？

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8年前发布47次阅读

客户电压在2.8V范围内。这将用于VCUAX和VCCIO2的交联设备吗？

根据表征数据，在2.375 V到3.465 V之间没有任何问题。因此，Vccaux可以在技术上运行2.8V。

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8年前发布47次阅读

我可以用LVCMOS输出驱动长PCB走线吗？

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8年前发布47次阅读

如何确定正在使用的时钟资源？

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4年前更新47次阅读

全新低功耗中端Avant FPGA平台市场注入新活力

“数十亿个由人工智能算法支持的互连传感器、设备和系统每天都在生成大量数据，这加速了对网络边缘智能的需求。这一趋势要求开发...

全新低功耗中端Avant FPGA平台市场注入新活力-ChipDebug

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全新低功耗中端Avant FPGA平台市场注入新活力-ChipDebug

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8年前发布46次阅读

我可以在VCCIO被分配到3.3伏的I / O bank中接收LVDS信号吗？

对于XP系列FPGA，提供给I / O bank的VCCIO将确定可以分配给该bank的输出，如LatticeXP系列数据手册的表2-8所示。但是，除LVCMOS1.8，LVCMOS1.5和PCI输入标准外，输入信号不依赖于提供给I / O bank的VCCIO。。因此，您可以将LVDS输入分配给使用3.3 V VCCIO的I ...

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8年前发布46次阅读

为什么我从TCP2JTAGVC2收到错误消息“无法连接到JTAGServer”？

TCP2JTAGVC2程序是LatticeMico32调试系统的一部分。尝试启动LatticeMico32调试会话后，将显示错误消息。在极少数情况下，安装LatticeMico32 System Builder软件时，不会设置运行TCP2JTAGVC2所需的环境变量。检查是否设置了ISPVM_DIR环境变量。为了使TCP2JTAGV...

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等级-LV1-ChipDebug

8年前发布46次阅读

我可以通过Windows驱动程序访问PCIe扩展功能寄存器吗？

简单回答是不。在Windows 2000 / XP / Server 2003中，PCIe总线被视为PCI总线。。PCI仅支持256个配置寄存器：每个功能0x00 - 0xff。。驱动程序调用仅使用8位地址，因此无法访问0xff以上。。使用随PCIe DevKit提供的标准驱动程序，您无法读回AER，设备串行数...

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等级-LV1-ChipDebug

8年前发布46次阅读

How to solve the issue of “ispVM System doesn’t detect parallel port ISP Download Cable” ?

导致无法找到下载电缆的原因有多种。以下是要检查的几件事。
首先，扫描您的电缆，看它是否可以自动检测。有时，电缆尚未自动检测到，并且为不同类型的电缆设置了选项。
打开ispVM。转到“选项” - ＆gt; “电缆和IO端口设置......”
单击“自动检测”。

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等级-LV1-ChipDebug

8年前发布46次阅读

1.5V时钟驱动器的可用性和成本使它成为驱动DDR3存储器接口的参考时钟输入的一个不吸引人的解决方案，有其他选择吗？

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8年前发布46次阅读

如何在Lattice Diamond原理图编辑器中的原理图上生成输入端口？

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8年前发布46次阅读

我可以编辑LatticeECP2 / M PCS自动配置以支持IPexpress GUI中没有的SERDES时钟倍频器吗？

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等级-LV1-ChipDebug

8年前发布46次阅读

Lattice是否支持通过JTAG端口编程SPI FLASH存储器？

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等级-LV1-ChipDebug

8年前发布46次阅读

我们已经编程了 iCE40 NVCM，我们可以重新编程吗？

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等级-LV1-ChipDebug

8年前发布46次阅读

如何清除ispVM文件菜单中的默认/最近项目（.xcf）？

启动ispVM时，如果存在默认文件，则会打开默认XCF文件。它还保留了最近打开的XCF文件的列表。
这些文件保存在c：\ WINDOWS \ ispVM.ini下的文件中。要删除默认/最近项目（XCF），请执行以下操作之一：
删除文件。将在ispVM的下一个会话中创建新文件。
。编辑...

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8年前发布46次阅读

FPGA配置-我如何重新配置一个3K/4K设备从菊花链？

描述一般描述：如何从一个菊花链重新配置一个3K/4K设备？解决方案有时需要在FPGA的菊花链中重新配置一个设备。这是可能的，尽管它需要对设计进行一些修改。在配置之前，用户可配置的引脚也被用作DIN和DOUT，应该在设计中连接在一起，以便在配置之后也存在连接...

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等级-LV1-ChipDebug

2年前发布46次阅读

提问在使用Diamond中的Reveal时，信号为灰色？

各位前辈，请问在使用Reveal进行调试时，想抓的信号为灰色，不能添加，这个问题怎么解决呢？

在使用Diamond中的Reveal时，信号为灰色？-ChipDebug

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等级-LV1-ChipDebug

8年前发布45次阅读

为什么Active-HDL Aldec许可证服务器在启动时不会自动启动？

有几种方法可以解决这个问题。请按照以下说明的分步说明进行操作：
在许可证管理器LMTOOLS GUI中，转到[Config Services]选项卡，选择Aldec许可证服务，然后选中“启动时启动服务器”复选框（左下角）。然后单击“保存服务”。如果这不能解决问题，请尝试以下...

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8年前发布45次阅读

在一个点阵I/O时序报告中M或最小速度等级意味着什么？

M或最小速度等级设备似乎比I/O定时报告中最快的速度等级更快，术语“最低速度等级”可能有点混乱。首先，它并不意味着最慢的硅器件。该术语指的是器件内的传播延迟时间（TPD），因此“最小速度级”实际上是最快的硅器件，或者换句话说，具有最小的TPD。这就是...

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等级-LV1-ChipDebug

8年前发布45次阅读

为什么我的Active-HDL Aldec许可证服务器在启动时不会自动启动？

有几种方法可以解决这个问题。请按照以下说明的分步说明进行操作：
在lmtools GUI中，转到配置服务选项卡，选择Aldec许可服务，然后选中“启动时启动服务器”复选框（左下角）。然后单击“保存服务”。如果这不能解决问题，请尝试以下步骤2。
加密狗驱动程序...

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8年前发布45次阅读

如何在FPGA的不同IO bank中定义不同的VCCIO电压，如SC / ECP2 / ECP2M / ECP3器件？为什么有必要？

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8年前发布45次阅读

LatticeECP3 FPGA PLL可以接受扩频输入时钟吗？

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8年前发布45次阅读

莱迪思器件可以承受多少次回流焊或波峰焊？

大多数莱迪思器件采用表面贴装（SMT）封装。我们的SMT封装适用于3个回流焊周期。我们没有波峰焊数据，因为它是一种主要用于通孔元件的焊接技术。有关更多详细信息，请参阅
。表面贴装器件的焊料回流指南 - TN1076
。。

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我们是否可以通过SPI / I2C / JTAG之类的编程端口重新配置MachXO3的SRAM结构来覆盖预编程到非易失性配置存储器（NVCM）中的过时设计？

是的，即使在NVCM预编程之后，也可以通过外部处理器通过SSPI / I2C / JTAG（sysCONFIG端口）重新配置MachXO3。但请确保NVCM已预先编程，并在Diamond Spreadsheet中启用了所需的sysCONFIG端口，以访问编程端口。
另请注意，如果器件进行了电源循环，或者接收到...

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iCEcube2 IEC 61508标准是否符合功能安全标准？

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8年前发布45次阅读

为什么保持分析使用不同的速度等级？

运行保持分析时，默认的速度等级运行是-M。 -M速度等级是整个过程中速度最快的设备，通常是保持分析的最差情况。。理想情况下，在查看保持分析时，IO时序报告应该在扫描所有速度等级时运行，以查找最坏情况路径。

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4年前更新45次阅读

打开通往30亿美元增量FPGA市场的新大门

全新低功耗中端Avant FPGA平台的面世，不但意味着莱迪思迈入了中端FPGA供应商的行列，还打开了一扇通往30亿美元增量市场的新大门...

打开通往30亿美元增量FPGA市场的新大门-ChipDebug

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8年前发布44次阅读

未使用的I/O引脚需要接地在设备中吗？

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