论坛标签 FPGA_Device_Families-ChipDebug-第7页

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FPGA_Device_Families

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等级-LV2-ChipDebug

6年前发布11次阅读

ISE StasxPPLORIE-Windows 7索引导致FATALHOLL错误：内部错误101

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6年前发布12次阅读

ISE StRAMXPLORER – HOSTLIST SEVER参数给出FATALL错误：内部错误101

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6年前发布7次阅读

2013.4 VIVADO HLS -添加和删除指令导致C代码的变化，并给出综合错误。

描述当我将一条管道指令添加到（UG81）Lab1设计（附加）的DCTIN内循环中，并移除它时，C代码就发生了变化，如下所示。这种行为只在ViVADO 2013.4中出现，在2013.3没有出现。原代码：DCTXououthyLoo:（k＝0；k<dctl大小；k++）<br>DCTI内循环：（n＝0...

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6年前发布18次阅读

[位置30415] I/O布局由于使用过度而失败

描述在执行过程中，我看到下面的错误：[位置30415] IO布局由于使用过度而失败我使用“-NoIIOBUF”开关禁用I/O缓冲器插入，但错误仍然可见。我怎样才能解决这个错误呢？解决方案为了禁用I/O插入和在OOC流中运行实现，使用“-Objo上下文”开关代替“-NoIIOBUF”...

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6年前发布6次阅读

2013.4 VIVADO综合：设计中与多个驾驶员相关的临界警告

描述在设计中出现多个驱动程序场景的情况下，在ViVADO中完成综合，只警告宽度不匹配。XST标记宽度不匹配和退出。ViVADO会发出错误而不是警告，以便用户得到警告吗？〔综合器83352〕多驱动网络NE00XXBAR/SAXBSSELYRGE[02]，第一驱动引脚xBAR/SAXBSSELYRG [0，2...

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6年前发布8次阅读

2013、X – VIVADO定时-我的心肺复苏是否定的。这不正确吗？

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6年前发布22次阅读

14.7映射-为什么和什么时候我会使用“-BP”映射选项（“映射切片逻辑到块RAM”）？

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6年前发布100次阅读

BITGEN——输出文件的解释（.BIT，.RBT，.BGN，.DRC，MSK，.ll，.NKY，.RBA，.RBB，.RBD，.MSD，.bin）

描述每一个BITGEN输出文件做什么，这些文件是什么时候产生的？解决方案钻头-（除非指定“-j”选项，否则总是生成）-包含专有标题信息和配置数据的二进制文件。意在输入到其他Xilinx工具，如PROFGEN和 iMPACT 。RBT-（在指定“-B”选项时产生）-“.BIT”文件的...

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6年前发布54次阅读

FPGA I/O -差分输入，如LVDS或LVPECL，不被驱动吗？

描述留下一个差分输入UN驱动的后果是什么？输入直流偏置吗？器件有损坏的危险吗？解决方案如果差分接收器的引脚的逻辑状态在它们离开时不重要（例如，如果输入寄存器已被禁用），则不需要做任何事情。如果存在足够的噪声，接收器的输出可能会切换，但是，这不...

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6年前发布84次阅读

ISE映射-“错误：MAPLIB：30 – LOC约束的坏格式……”

描述如果PIN被分配给无效的器件位置或被错误地指定，MAP报告以下错误：错误：MAPLIB：YYY上的LOC约束XXX的30坏格式。解决方案此...

ISE映射-“错误：MAPLIB：30 - LOC约束的坏格式……”-ChipDebug

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6年前发布26次阅读

JTAG BSDL——Xilinx是否为配置的器件提供配置的BSDL文件？

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6年前发布100次阅读

ViVADO——我如何在VIVADO IDE中创建自定义的TCL命令和相应的GUI按钮？

描述有一个我经常使用的特定的TCL命令。有没有办法在ViVADO IDE中创建一个按钮来自动执行这个命令？解决方案这个特性在VIVADO设...

ViVADO——我如何在VIVADO IDE中创建自定义的TCL命令和相应的GUI按钮？-ChipDebug

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