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jenmyliu
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jenmyliu
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基于 FPGA 及深度学习的人脸检测系统设计
第一部分 设计概述1.1 设计目的新冠病毒的肆虐让整个 2020 年笼罩在恐慌之中，戴口罩成了人们外出必备 的“新日常”。新冠病毒主...
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jenmyliu
3年前更新
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FPGA实现PID控制算法
一. 简介
相信大家对于PID控制算法，都不感到陌生了，平衡车就是靠它平衡起来的，还有飞控的平衡算法也是它，以及FOC中的闭环控...
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jenmyliu
3年前更新
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基于FPGA的图像处理
图像处理系统设计注意点：1.将算法开发和FPGA实现分离用软件的图像处理环境可以使用大批量的图像样本进行测试及调试算法，再将算...
FPGA常见问题
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jenmyliu
1年前更新
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usb3.0信号的仿真和布线设计要求
usb3.0信号速率为5Gbps，相对于usb2.0高速信号480Mbps来说几乎是10倍的增长。采用的8b/10b的编码方式，这种编码方式只有80%的效...
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jenmyliu
1年前更新
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Allegro如何查看走线的宽度
1.设置想要显示的单位，mm或者mil
2.Find中勾选Cline segs，点击感叹号，双击走线，查看结果。
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jenmyliu
1年前更新
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Allegro更改过孔网络
1.打开pcb界面，点击logic--Assign Net to Via...
在Options界面选择网络，然后点击需要更改的过孔。
2.如果在logic里没找到Assi...
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jenmyliu
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[经验] Allegro极坐标布局方法
本人使用allegro工具已有2年之久，深深了解到工具是帮助你快速解决问题的利刃，需要充分了解工具的性（功）能，方可游刃有余，有...
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jenmyliu
1年前更新
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Allegro PCB对line等对象进行换层
使用change命令，在Find面板中勾选对象，例如是line，
在Options面板中的subclass中选择需要换层的对象：
注意上述方法只是针对C...
PCB设计
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jenmyliu
1年前更新
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Allegro修改元件封装管脚序号
对于用Allegro画PCB来说，其中画元件封装是最头疼的事，100个芯片就有100种封装，况且要从焊盘画起，自从有了“封装生成器”，画...
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jenmyliu
1年前更新
84次阅读
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浅谈Allegro进行DRC检查报错：Package to Package Spacing
Allegro设计PCB文件的时候，进行DRC检查，如果报错：Package to Package Spacing ，是否会影响实际使用，实践经验表明不影响。
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jenmyliu
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allegro设置自动保存方法
utosave:是否开启自动保存，若需要开启，请将其选中autosave_dbcheck：自动保存前是否进行dbcheck，选中保存时间可能会长...
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jenmyliu
1年前更新
13次阅读
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Allegro保存时会提示是否覆盖解决办法
allegro每次保存会提示是否覆盖，极为讨厌，可以在设置中将其关闭即可。方法如下：
PCB设计
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