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jenmyliu
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jenmyliu
1年前更新
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【Cadence】Allegro16.6过孔的基本操作
1.添加过孔
allegro没有单独 放过过孔的功能，只有布线的时候 双击添加过孔。或者通过复制粘贴方式放置。
如果在铺铜上添加过孔...
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jenmyliu
1年前更新
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Cadence Allegro PCB如何快速查找元器件
前言设计好的PCB我们能经常需要快速查找某个元器件。一、点击菜单栏的show element命令二、在find栏中输入要查找的器件勾选symbo...
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jenmyliu
4年前更新
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FPGA学习-VHDL和Verilog中数组定义、初始化、赋值方法
VHDL和Verilog数组的定义、初始化、赋值的方法不只一种，以下是本人常用的方法，可能不是最方便的，但是比较好理解，...
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jenmyliu
4年前更新
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FPGA学习-PL控制PS端DDR的设计
构建SoC系统，毕竟是需要实现PS和PL间的数据交互，而像上一讲那样PL主机与PL从机之间通过AXI4-Lite总线进行交互有点杀鸡用牛刀了...
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FPGA常见问题
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jenmyliu
1年前更新
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usb3.0信号的仿真和布线设计要求
usb3.0信号速率为5Gbps，相对于usb2.0高速信号480Mbps来说几乎是10倍的增长。采用的8b/10b的编码方式，这种编码方式只有80%的效...
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jenmyliu
3年前更新
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FPGA实现PID控制算法
一. 简介
相信大家对于PID控制算法，都不感到陌生了，平衡车就是靠它平衡起来的，还有飞控的平衡算法也是它，以及FOC中的闭环控...
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jenmyliu
1年前更新
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Allegro修改元件封装管脚序号
对于用Allegro画PCB来说，其中画元件封装是最头疼的事，100个芯片就有100种封装，况且要从焊盘画起，自从有了“封装生成器”，画...
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jenmyliu
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易灵思FPGA—LVDS资源使用
易灵思FPGA的LVDS设置使用一、LVDS概述二、IP调用三.代码定义小结一、LVDS概述LVDS，Low Voltage Differential Signaling，低...
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jenmyliu
1年前更新
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Allegro如何放置过孔并查看过孔参数
1.放置过孔
在布线模式下，双击鼠标左键，即可放置过孔
2.查看过孔参数
先在布局布线模式下的Find下选中Vias，然后再选中Tools-P...
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PCB设计
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jenmyliu
4年前更新
302次阅读
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紫光同创软件 Pango Design Suite (PDS) 报错 synplify.srr failed 的解决办法
如图出现如下错误只需要设置project-setting 中吧synplify改成ADS，再重新编译即可。因为默认是synplify，如果没有license。只需...
Pangomicro紫光同创
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jenmyliu
1年前更新
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AntiPad反焊盘越大，过孔阻抗跌落就越小
AntiPad反焊盘越大，过孔阻抗跌落就越小
AntiPad就是通常我们所说反焊盘。下图的为一对差分线过孔，在GND平面的图。
过孔到铜皮...
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jenmyliu
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FPGA实现Cordic算法求解arctanθ
一. 简介
由于在项目中需要使用的MPU6050，进行姿态解算，计算中设计到arctan 和 sqr(x*2 + y * 2),这两部分的计算，在了解了...
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