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Poison
4年前更新
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Xillinx FPGA的设计约束阅读整理
《适用于FPGA和SOC的UlteraFast设计方法指南》（UG949）
《Vivado Design Suite 用户指南：设计分析与收敛技巧》(UG906)
《Vivad...
Xilinx-AMD
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Poison
4年前更新
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【FPGA】相比CPU、GPU、ASIC，FPGA还有没有生命力？
最近几年，FPGA这个概念越来越多地出现。例如，比特币挖矿，就有使用基于FPGA的矿机。还有，之前微软表示，将在数据中心里，使用...
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FPGA新闻资讯
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Poison
2年前更新
1099次阅读
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Synopsys Cadence 最新EDA软件分享，含VCS DC DVE Verdi Spyglass Hspice ICC2 PT Libcompiler Synplify Coretools Fm indago XCELIUMMAIN INNOVUS 等
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FPGA CPLD资料源码分享
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Poison
3年前更新
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AMD发布Xilinx FPGA芯片涨价函，最高涨25%！
1、供应链称AMD已通知涨价11月22日业界消息传出，AMD向经销商发送了一封涨价函。来源：供应链从文件内容来看，AMD在通知中表示...
FPGA新闻资讯
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Poison
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亚稳态详解
一、介绍
在同步系统中，数据始终相对于时钟具有固定的关系 当该关系满足设备的建立和保持要求时，输出将在其指定的传播延迟时间...
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FPGA常见问题
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Poison
4年前更新
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时序基础概念专题（一）
一、静态时序分析1.1、什么是STA（Static Timing Analysis/静态时序分析）静态时序分析是一种通过对添加延迟的时序路径（包括栅...
FPGA常见问题
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Poison
4年前更新
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时序基础概念专题（一）
一、静态时序分析
1.1、什么是STA（Static Timing Analysis/静态时序分析）
静态时序分析是一种通过对添加延迟的时序路径（包括...
FPGA常见问题
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Poison
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时序基础概念专题（二）
2.2 时序路径的种类
数字逻辑可以分解为许多时序路径，时序路径可以是以下任意一种：
1、寄存器/锁存器的时钟引脚到另一个寄存器...
FPGA常见问题
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Poison
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IP核讲解DMA/Bridge Subsystem for PCI Express（一）
一、基本介绍赛灵思7系列的FPGA都支持PCIe(Integrated Root Port and Endpoint)，Artix™-7支持Gen2x4的IP配置，Kintex™-7 和 V...
FPGA常见问题
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Poison
3年前更新
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以太网IP核代码（verilog）
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FPGA开源项目
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Poison
4年前更新
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学习FPGA的小Tips（一）
一、Verilog 编码风格
（本文的语法高亮因为浏览器的缘故，所以不准确）
1.1 使用“`include编译器指令”
文件包含“`include编译器指令”用于在合成过程中将源文件的全部内容插入到另一个文件中。它通常用于包括全局项目定义，而无需在多个文件中重复相同的...
FPGA常见问题
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Poison
4年前更新
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IIC专题代码篇（二）
三、顶层模块// synopsys translate_off
`include "timescale.v"
// synopsys translate_on
`include "i2c_master_defines.v"
FPGA常见问题
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