Lattice-莱迪斯

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莱迪思半导体公司是美国的一家半导体公司，专门从事低功耗，现场可编程门阵列的设计和制造。

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tststs

3年前发布115次阅读

提问工程添加调试文件.rvl后，在translate design步骤报错：logical block ” with type ” is unexpanded。

请教各位一个问题，lattice diamond3.12工程中添加.rvl调试文件后，在translate design步骤报错，logical block '' with type '' is unexpanded。用LSE综合可以通过，用synplify pro就会报错，这是什么原因？

5年前发布106次阅读

lattice crosslink mipi硬核，如何用modesim仿真

lattice crosslink mipi硬核，如何用modesim仿真？

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popomao

8年前发布275次阅读

LATTICE FPGA 软件 diamond里面，Verilog 和 vhdl可以混合调用吧？

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ii1397

9年前发布2594次阅读

精怎样在线申请LATTICE FPGA 软件的LICENSE？

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starkwang

4年前更新162次阅读

Lattice推出了基于超低功耗FPGA up5k （iphone手机上曾用）的TinyML开发平台的开源方案

Lattice推出了基于超低功耗（iphone手机上曾用的up5k）FPGA的TinyML开发平台，并且开源了声音和人脸识别的开源方案。视觉、...

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xilinx_fpga

4年前更新404次阅读

已解决lattice diamond SynplifyPro 编译错误 “Can’t open input file”

在lattice diamond软件编译参考设计时出现如下错误，对参考设计没做任何修改，综合工具选的是SynplifyPro，上周还可以没有问题,大伙能帮忙看看吗？ERROR - NF100 |Can’t open input file F:\dsirxreferencedesignrgb8882lane\rd1185_mipi_dsi2parallel_bridg...

chipdebug

超级版主1

用synplify打开看看。参考这个提问，https://chipdebug.com/forum-post/449.html

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yuanxiaowa

4年前更新786次阅读

全网最详细Lattice ddr3教程之仿真和时序约束全攻略

Lattice ddr3教程全攻略之仿真篇对于这部分，首先建议安装好diamond,modelsim se 10.1a这两个软件，如果想仔细分析DDR3的IP部分...

+32

wuzhihua2

8年前发布189次阅读

对Lattice MIPI DSI TX RD1184参考设计中dcs_rom模块的疑惑

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chengfeng

4年前更新192次阅读

已解决LATTICE ECP5 FPGA DDR3 MEM 如何仿真？

LATTICE ECP5 FPGA DDR3 MEM 如何使用MODELSIM仿真？

wuzhihua2

首先目录下的inst1_eval.do文件

注意下面的路径以及diamond的版本改为你自己的

然后启动modelsim键入以下命令进入仿真所在目录，注意替换成你对应的目录

然后键入以下命令运行仿真

可以看到仿真波形以及输出的调试信息

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ii1397

9年前发布168次阅读

LATTICE FPGA的DDR3 IP core 可不可以使用93.75M时钟？

请问DDR的ip core中，有个接口时钟频率的选项，可选的时钟范围为100~400MHZ，但是我实际的接口时钟并没有那么高，只有93.75M，这种情况会不会影响DDR ip core的使用？换个角度说，如果接口时钟达不到DDR ip core要求的时钟，该如何处理？

wuzhihua2

你在IPCORE的配置界面设置为100m，然后实际用90m的时钟没有问题。

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lattice_wiki

8年前发布42次阅读

ICECUBE2砂纸抛出错误，表示无法放置PLL实例。用户如何解决这个问题？

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-1

bless_l

8年前发布173次阅读

lattice芯片，请问如何把两个时钟约束成异步？

lattice芯片，请问如何把两个时钟约束成异步在网上，能找到的lattice资料比较少

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lattice_wiki

8年前发布15次阅读

格子的IIS模型包括每个引脚的RLC数据吗？

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8年前发布9次阅读

是否有不同Power Manager-II设备的速度等级，例如ispPAC-POWR1220AT8或ispPAC-POWR1014A？

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lattice_wiki

8年前发布31次阅读

Place and Route TRACE报告的“潜在回路”部分是什么意思？

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8年前发布75次阅读

我需要给未使用的IO银行供电吗？

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8年前发布17次阅读

为什么在格子菱形跟踪报告中，我的LATECIEC2M输入DDR接口通过输入设置优先，但在板上失败？

在实现通用DDR接口时，需要用户使用IPExpExt生成接口。如果不使用IPExcel，用户就不能实现将Delayb元素传递给IDRDX模块。在LATECIEC2M设备上，如果在IDRDX之前不使用DelayB元素，则跟踪报告中使用的输入数据延迟值与硅不匹配。导致跟踪报告与硅的结果之间的差...

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8年前发布24次阅读

电源管理器II设备能支持热插拔吗？

是的，电源管理器II设备支持热插拔。电源管理器II的所有引脚都是热插槽投诉。在使用VCCD或VCCA之前，在引脚上施加最大指定的I/O电压没有问题。但是，应注意数据表中指定的小泄漏电流。EG：请参阅POWR1220AT8泄漏电流规格的设备数据表。

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8年前发布7次阅读

当我将TX的LaTeCeCp3 Serds/PC配置为RX串行回送模式时，为什么我会收到数据错误？

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8年前发布56次阅读

在Place and Route TRACE报告中，在哪里可以看到输入延迟块中所做更改的结果？

该
放置和路线TRACE
如果延迟值是静态的，报告将仅显示输入数据DELAY块的延迟。这些变化可以在“DI_SET”＆amp;的值中看到。 INPUT_SETUP首选项部分下的“DI_HLD”参数
跟踪

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8年前发布15次阅读

为什么我的ispVM系统软件无法正确识别Platform Manager？

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8年前发布24次阅读

为什么在混合语言设计中，顶级信号被列为网络，而不是Reveal Hardware Debugger Inserter中的端口？

在混合语言设计中，原始设计由Synplify Pro转换为EDIF网表。 Reveal Inserter工具使用此EDIF网表，该工具目前仅解析网络名称，但不解析混合语言设计中的端口名称。。此功能将在未来的Lattice Diamond设计软件版本中得到改进。。当使用混合语言设计时，改进将...

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8年前发布25次阅读

我可以模拟ProcessorPM-POWR605吗？

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8年前发布119次阅读

运行ispVME时为什么会收到错误消息？

ispVM Embedded（ispVME）生成错误消息的一个原因是由于ispVME C代码版本与Programmer生成的ispVME数据文件版本不匹配。 ispVME代码和数据是匹配对。程序员生成的数据文件与ispVME C代码匹配非常重要。它们必须同步。
一个示例消息是：
。cCurBit：0x0，bit：...

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8年前发布18次阅读

ICE40LP/HX设备的所有PIOS都有内部拉起吗？

ICE40LP/HX装置有四个IO库-BANG0、BANG1、BANG2和BANG3。所有与BAN0、BANG1和BANG2相关的IOS都具有内部上拉。BAN3内部的IOS没有内部上拉。BANG3没有内部上拉可用。

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8年前发布8次阅读

并行运行多个PAR作业所需的Linux环境变量及其值是什么？

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8年前发布20次阅读

如果我在“等待好的”序列步骤中分配一个输出，当它变得活跃时？

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8年前发布15次阅读

当我的LatticeEC标准评估板插入PC的PCI插槽时，为什么Reveal硬件调试器无法正常工作？

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8年前发布17次阅读

为什么GLIBCXX.X文件在我的菱形菱形设计软件RHEL安装中丢失，即使正确的环境设置已经完成了吗？

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lattice_wiki

8年前发布18次阅读

如何更改ProcessorPM-PM605上的定时器？

该设备是可编程的，如果需要，您可以使用PAC-Designer进行更改。默认情况下，出厂配置可编程为实现电源监控器，复位发生器和看门狗定时器。看门狗的定时器功能有2个引脚，可以绑定达到500毫秒，2秒，10秒，1分钟。。这些是WDT-Sel0，WDT-Sel1引脚。。脉冲拉伸...

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