社区标签 Simulation-ChipDebug-第3页

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Simulation

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等级-LV1-ChipDebug

8年前发布17次阅读

如何在ActuvDL波形编辑器中显示信号层次？（我想看看给定信号的设计层次。）

要查看给定信号的设计层次结构，可以做到以下几点：调用ActuvDL波形编辑器。将您的鼠标移到波形编辑器顶部的列标题（例如“名称”、“值”等）。右键单击“列”-gt；“层次结构”您会看到“层次结构”列出现。注意，层次结构不包括TestBoeLead。即层次结构从...

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8年前发布33次阅读

如何让Aldec ActiveHDL波形查看器放大到足以查看模拟的详细信息？

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8年前发布47次阅读

为什么在混合Verilog / VHDL设计模拟中出现“ELAB2_0093”错误？

当您的顶层设计采用VHDL时，会发生这种情况，但其中一个较低级别的模块（例如，使用IP Express生成的PLL）位于Verilog中。
请注意，Lattice OEM Compiled库对VHDL和Verilog有不同的命名法。例如，“sc”是VHDL的SC / M库名称，“ovi_sc”是Verilog的SC / M库...

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8年前发布33次阅读

为什么莱迪思没有意识到安装了ALDEC Active-HDL？

问题：当您的PC上安装了ALDEC Active-HDL时，莱迪思ispLEVER软件未设置为自动使用ALDEC Active-HDL。用户必须手动配置ispLEVER以识别PC上安装了ALDEC Active-HDL。
要配置ispLEVER以启动ALDEC Active-HDL模拟器，请按照下列步骤操作：
双击桌面上的ispLEVER图...

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8年前发布33次阅读

加载波形后，为什么Active HDL会挂起？

如果在不同的循环中使用相同的变量，有时会发生这种情况。在下面的示例中，建议您为第二个始终块定义新的整数变量，模拟器将不再挂起。
整数ii;
...
总是@（*）

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8年前发布35次阅读

如何在批处理模式下调用和使用Active-HDL莱迪思版？

要在批处理模式下运行Active-HDL莱迪思版，可以从DOS命令窗口执行“vsimsa”命令。 “vsimsa”没有任何图形用户界面（GUI）。它对于运行自动脚本或回归测试很有用，它可以从命令窗口调用为“vsimsa -do macro”。
以下是用于模拟Verilog设计的示例宏文件。由...

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8年前发布33次阅读

我怎样在Active-HDL Lattice版中调用使用GUI模式

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8年前发布29次阅读

为什么由于库不兼容而导致Modelsim Library出错？

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8年前发布55次阅读

为什么在波形窗口中显示的Aldec Active-HDL仿真数据库和仿真结果无法自动刷新？

默认情况下，“波形”窗口中显示的模拟数据库和结果不会自动刷新。只有在模拟步骤完成或模拟停止后，才能对模拟数据库进行更改。这意味着信号历史记录的显示将被冻结，直到运行命令完成（或模拟被用户或断点中断）。通过使用可以更改此行为
-asdbrefresh
论证...

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8年前发布45次阅读

为什么Active-HDL Aldec许可证服务器在启动时不会自动启动？

有几种方法可以解决这个问题。请按照以下说明的分步说明进行操作：
在许可证管理器LMTOOLS GUI中，转到[Config Services]选项卡，选择Aldec许可证服务，然后选中“启动时启动服务器”复选框（左下角）。然后单击“保存服务”。如果这不能解决问题，请尝试以下...

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8年前发布32次阅读

为什么我的仿真显示输出时钟相位相对于PLL中的输入时钟不断变化？

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