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FPGA CPLD
Lattice-莱迪斯
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莱迪思半导体公司是美国的一家半导体公司，专门从事低功耗，现场可编程门阵列的设计和制造。
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LATTICE FPGA 用户将所有BNAK设置为3.3V，并且用户想要分配输入缓冲区LVTTL33，却不能选择“N / A”。
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XO2 IO缓冲输出可以支持mini-LVDS吗？
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如何在DDR接口中分配虚拟VCCIO引脚，无论它是连接到PCB上的VCC还是GND？
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即使我在Crosslink的MCLK频率中设置48MHz的MCLK频率，为什么还是24 MHz？
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MachXO3的上电和断电顺序如何？
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如何对CRAM和/或程序配置进行CRC校验？
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参考设计RD 2033“使用紧凑型CNN加速器IP的关键短语检测”的操作原理。它是否使用FFT？
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如何正确地在VHDL中实例化SB_RGBA_DRV？
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为什么我在sensAI Compiler 1.1中得到“list index out of range”错误？
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MachXO2器件是否支持LatticeMico8 / LatticeMico32软处理器？
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LATTICE FPGA PLL能否支持通过WISHBONE动态更新？
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LATTICE DIAMOND如何使MAP和PAR自动使用I / O触发器？
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如果没有外部SPI，LATTICE PGA器件 EXT-NVCM的启动时间是多少？
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如果sublvds2csi2 IP的许可证不起作用怎么办？
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在映射时，DPHY映射到DPHY0。我似乎无法找到将映射更改为DPHY1的方法。是否可以转移到DPHY1？
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器件号LCMXO1200C-3FTN256C与以前的XO1200器件有不同的芯片吗？
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如何从“Fault”中恢复并等待某些事情继续进行操作？
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当通过仿真确认CMOS到DPHY IP时，16位短包数据序列输出如下0,1,0,1,0,1,0,1 ……这是正确的吗？
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是否有LATTICE开发板可以支持开箱即用连接4通道CSI-2相机？
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在哪里可以找到Crosslink的Masterlink IO Link（B-IOL-EVN-BRD）中缺少的插件I / O引脚说明？
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xilinx_fpga
Lattice Crosslink-NX比特流(bitstream)压缩以及转换为C文件的方法介绍
xilinx_fpga
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白与阶下行
我使用的lattice diamond 版本是3.12，如何将程序固化到板子里？
白与阶下行
2年前发布
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墨言
有没有大佬能提供一个带用户逻辑的lattice ddr3 的测试小工程
墨言
2年前发布
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boshenlm
lattice mox2 的jed 文件回读出来 CFG区域全是1 这是被加密了吗？
boshenlm
2年前发布
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tfh
ECP5 如何加密的同时也压缩bit流文件
tfh
2年前发布
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xiaojinge
求助：modelsim仿真输出波形乱码（附完整VHDL代码及仿真图）
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xiaojinge
2年前发布
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asdas
可不可以把纯HDL程序的IO口映射到D-PHY上面
asdas
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白与阶下行
Lattice Diamond 引脚分配报错
白与阶下行
3年前发布
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asdas
diamond 的MIPI D-PHY V1.1这个IP要如何控制输入HS才会有输出
asdas
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以太风吹
DSP模拟JTAG接口对LATTICE CPLD进行在线编程加载开发，有偿
以太风吹
3年前发布
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