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FPGA开源项目-ChipDebug

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等级-LV1-ChipDebug

2年前更新83次阅读

如何将 FPGA 变成 USB 数据采集板

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等级-LV2-ChipDebug

2年前更新155次阅读

FPGA/IC优质开源项目（二）

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等级-LV4-ChipDebug

3年前更新33次阅读

FPGA上的AXI-4接口的RAM Tester 测试 verilog源码

这是个用于在32位的AXI-4总线上进行内存性能读写测试的IP Core.它也能用于读写校验。访问是通过AXI-4突发操作完成的。简单用例如下：##################################################################
# run_ram_test: Write pattern to RAM array
######...

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等级-LV2-ChipDebug

3年前更新280次阅读

FPGA/IC开源网站推荐

之前零零散散的推荐过相关的网站和开源项目，现在汇总一下几个特别优秀的开源项目或者网站。具体的网站概述和基本操作见视频，视频有点长。OpenCores开源IP聚集地，里面有大量I2C，SPI，CAN，微处理器等IP，视频中的I2C代码经常会被开源处理器调用，有Veril...

1

等级-LV2-ChipDebug

3年前更新56次阅读

AXI-Stream的IP核

今天带来的开源IP是AXI-Stream 语言：Verilog来源：https://github.com/alexforencich/verilog-axis/介绍：AXI Stream 总线组件的集合。大多数组件的接口宽度都可以完全参数化。包括带有智能总线协同仿真端点的完整 MyHDL 测试平台。特点：AXI stream bus wi...

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等级-LV4-ChipDebug

3年前更新118次阅读

一个用 Verilog 编写的 32 位 RISC-V 内核和一个支持 RV32IM 的指令集模拟器

一个用 Verilog 编写的 32 位 RISC-V 内核和一个支持 RV32IM 的指令集模拟器。该内核已针对协同仿真模型进行了测试，并在 FPGA ...

一个用 Verilog 编写的 32 位 RISC-V 内核和一个支持 RV32IM 的指令集模拟器-ChipDebug

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等级-LV4-ChipDebug

3年前发布130次阅读

FPGA上可以用的开源的32 位 RISC-V ISA CPU 内核verilog代码

iRISC-V - 32 位双发 RISC-V CPUGithub：http: //github.com/ultraembedded/biriscv特征32 位 RISC-V ISA CPU 内核。超标...

FPGA上可以用的开源的32 位 RISC-V ISA CPU 内核verilog代码-ChipDebug

FPGA上可以用的开源的32 位 RISC-V ISA CPU 内核verilog代码-ChipDebug

FPGA上可以用的开源的32 位 RISC-V ISA CPU 内核verilog代码-ChipDebug

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等级-LV4-ChipDebug

3年前发布99次阅读

uriscv – 另一个开源的可在FPGA上运行的小型 RISC-V CPU verilog源码

简单、小型、多周期的 32 位 RISC-V CPU 实现。大多数指令需要 2 个周期，除了需要 4 个以上周期的加载/存储（取决于内存延迟）和最多可能需要 34 个周期的除法。特征32 位 RISC-V ISA CPU 内核。支持 RISC-V 的整数 (I)、乘除法 (M) 和 CSR 指令 (Z) 扩展 (R...

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等级-LV2-ChipDebug

3年前更新96次阅读

FPGA/IC优质开源项目（七）综合

导言本期主要带来VHDL的开源项目，也是第一次集中发VHDL的IP，包括：AXI-full（VHDL），AXI-lite（VHDL），Datamover（VHDL），M...

FPGA/IC优质开源项目（七）综合-ChipDebug

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等级-LV2-ChipDebug

3年前更新144次阅读

FPGA/IC优质开源项目（四）Corundum

1基本介绍Corundum 是一种基于 FPGA 的开源、高性能 NIC 和网络计算平台。功能包括高性能数据路径、10G/25G/100G 以太网、PCI ...

FPGA/IC优质开源项目（四）Corundum-ChipDebug

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等级-LV4-ChipDebug

3年前更新48次阅读

FPGA上可以使用的开源USB-CDC 设备IP核 verilog源码分享

该组件是一个简单的 USB 外设接口（设备）实现，枚举为高速 (480Mbit/s) 或全速 (12Mbit/s) CDC-ACM 设备。该 IP 具有用于输入和输出数据的简单 FIFO 接口（有效、数据、接受），以及用于连接到 USB PHY 的 UTMI 接口。特征高速或全速 USB CDC 设备。硬件枚举...

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