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赛灵思是FPGA、可编程SoC及ACAP的发明者, 其高度灵活的可编程芯片由一系列先进的软件和工具提供支持,可推动跨行业和多种技术的快速创新- 从消费电子类到汽车类再到云端。
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4.1 ECS– iPad、OPAD、IOPAD的符号在哪里?
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McBLASZ-XMD -“错误:目标板上的XMD存根没有正确初始化……”
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4.2i基础逻辑仿真器-“警告9199:未知组件-II8,XY-CKDLLE,警告9193:一些IC模型未加载……”
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4.1i ViTEX-II MAP-在版本4.1i中工作的RPM在版本4.1i中失败
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7.1i定时分析仪/TrCE(跟踪)-“警告:定时:2589 -固定相位移在DCM’XXX’上使用,没有适当的周期…”
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91i负时基负触发器产生不同于TRCE /时序分析器所报告的松弛值
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4.1i核心生成器,ViTEX II,异步FIFO -在什么情况下WrErrr和rdyErr信号被激活?
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4.1i NGDBudi–用户文档错误地指出,对于所有GT变体,必须将“RyxLoSyx”的“SythCycFSM”设置为“true”。
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4.1i核心生成器-内存编辑器产生.COE文件,导致XC4000/Spartan注册ROM内核中无效的基数错误
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安装-警告:“USB尚未通过Windows Logo测试以验证与WindowsXP的兼容性”当安装在WindowsXP上的驱动程序时发生
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4.2i DATA2BRAM指定的块RAM不以正确的结果更新
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4.1i计时分析器-“致命错误:定时BasWoFutStuf.C:582: 1.51 -时钟到达没有找到!进程将终止。”
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VelTEX II,速度文件- TrCE/TIOKIP(IOB寄存器设置/保持)报告在TrCE/时序分析器不匹配数据表(数据有效窗口)
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*过时的*4.1i SP3冲击-接地TDO导致Dr.Watson错误,并且屏幕充满了器件(长链)。
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5.1i xST -“错误:HDLPARSIES:3264 -不能读取文件文件名.VHD:没有这样的文件或目录……”
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4.2i时序分析器/TrCE(跟踪)-在时序报告中出现过度负的TDCMIO
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如果CdkFb不在DCM上使用,VelTEXI/PRO,VIRTOX-4,VIRTOX-5 DCM会锁定信号吗?
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由“XDL -NCD2xDL”生成的4.1i XDL CONFIG字符串只列出了可能存在的一条路径。
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ProjaveNavigor是项目导航器可用的“自动保存”函数吗?
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VXTEX-II是XCV2000 E引脚兼容XQV2000 E?
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4.2i核心生成器-“错误:内部错误已经发生;为了解决这个错误,请查阅…/错误:Sim有一个问题,实现选定的核心……”
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CPLD -一个设计在一个推荐的工作温度范围内正常工作,而不是在另一个推荐的工作温度范围内。
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4.1I模块化设计——在主动实现模式下使用-TF选项时NGD2ver中出现分段错误
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4.2i项目导航器-我不能集成ISE与导师图形(设计管理器/设计架构师)版本En2001 1.1
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示意图-符号太大以至于不能正确地放置在示意图上
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2002、LeonardoSpectrum -当使用“-SyopiStTraseEXOFF”指令时,软件挂起
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CPLD输出取决于引脚位置
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当我的时序仿真导致错误的逻辑时,有哪些项目需要检查?
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CPLD -功能仿真失败了——我该检查什么?
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*过时的*4.2i影响-我不能创建.sf或.sasl文件,因为选项在GUI中被格式化了
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