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FPGA CPLD
Lattice-莱迪斯
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莱迪思半导体公司是美国的一家半导体公司,专门从事低功耗,现场可编程门阵列的设计和制造。
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xilinx_fpga
在Lattice MIPI DSI TX RD1184参考设计上增加了个复位模块,部分信号输出异常,请问如何定位问题点?
1
xilinx_fpga
6年前发布
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wuzhihua2
对Lattice MIPI DSI TX RD1184参考设计中dcs_rom模块的疑惑
1
wuzhihua2
2年前回复
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xilinx_fpga
运行Diamond 3.1 Translate Design出现 “there is no active CLK. ” 错误怎么解决?
1
xilinx_fpga
6年前发布
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xilinx_fpga
在用Lattice Diamond 3.1软件过程中,遇到Synthesis exit by 9. Done: error code 9 怎么解决?
xilinx_fpga
6个月前回复
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popomao
求助,LATTICE XO2 FPGA下载失败遇到下面错误,怎么检查?
popomao
6年前发布
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ipqsn
请问LATTICE的XO2\XO3(CPLD\FPGA) 器件怎样执行加密操作?
ipqsn
6年前发布
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popomao
lattice 的XO3 FPGA 可以支持Mini-LVDS吗?
popomao
6年前发布
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fuckfpga
使用LATTICE的XO3器件进行调试时,reveal报错”Falied to link signal”怎么解决?
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fuckfpga
6年前发布
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chengfeng
lattice XO3真双口ram AB两个口数据不同步的问题有人遇到过吗?
chengfeng
6年前发布
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chengfeng
为什么LATTICE XO2的CPLD明明有内部晶振,但它的开发板上还要提供外部晶振?
chengfeng
6年前发布
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inner
Lattice diamond 编译XO3的MIPI工程时报错” Cannot place PIO … because the types of their IOLOGICs are incompatible”, 怎么解决?
inner
6年前发布
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chipdebug
在Lattice CrossLink 器件中使用嵌入式逻辑分析仪Reveal方法
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chipdebug
6年前发布
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inner
为什么使用ICT programmer 通过SVF文件进行编程会比使用LATTICE Diamond programmer 通过USB下载线编程慢很多,有没有办法提速?
inner
6年前发布
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inner
对于Lattice FPGA/CPLD XO2编程,“Flash erase, program, verify, secure”和“Flash erase, program, verify, secure plus”有什么区别?
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6年前发布
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inner
我可以整合像Tortoise Svn这种第三方插件到Lattice Mico系统中吗?
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6年前发布
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inner
对于lattice FPGA 器件内硬化的从SPI的EFB仿真,一旦收到的数据字节传输到SPI接收数据寄存器,需要多长时间来设置RRDY位?
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6年前发布
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inner
在远程计算机上调用PAR(Place and Route)时,为什么LATTICE diamond会将作业分派给远程计算机,并且所有远程计算机上的所有PAR之前的操作都会被跳过?
inner
6年前发布
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如何在Lattice CPLD XO2系列器件中执行TransFR(透明传输)操作?
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6年前发布
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Lattice FPGA在diamond的IPexpress中,在频率模式下配置PLL时,IPexpress工具是否可以使用小数N值?
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6年前发布
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LATTICE CPLD MachXO2的Master I2C(EFB)接口是否完全符合I2C 100kHz标准的时序要求?
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6年前发布
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inner
Lattice March Xo2 CPLD 所能输出的最大电流和最大功率是多少?
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6年前发布
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fuckfpga
请教大家,用lattice diamond programer烧录jed文件到芯片上报错“Faild to verify the ID”怎么解决?
1
fuckfpga
6年前发布
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MCU如何通过Slave SPI接口使用hex文件对Lattice iCE40 FPGA(CRAM)编程?
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6年前发布
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Lattice FPGA的“DONE_EX”设置选项是什么意思?
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6年前发布
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LATTICE CPLD FPGA即使设计只做很小的更改,如果要查看物理(physical)视图和布局视图(floor)也需要运行完整的编译流程吗?
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6年前发布
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LATTICE FPGA\CPLD 的锁相环PLL在什么情况下会失锁?
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6年前发布
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LATTICE FPGA 如何修改JESD207 IP核MCLK时钟的默认频率(90MHz)?
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6年前发布
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如何使用C程序对LATTICE(莱迪思)的FPGA / CPLD进行编程,是否有相关文档?
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6年前发布
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为什么使用Active-HDL Lattice专用版进行仿真时会出现KERNEL: Error等错误?
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6年前发布
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Lattice(莱迪思)的部署工具 Diamond Deployment Tool支持PCF(Pattern Control Format)格式吗?
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6年前发布
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