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FPGA CPLD
Lattice-莱迪斯
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莱迪思半导体公司是美国的一家半导体公司，专门从事低功耗，现场可编程门阵列的设计和制造。
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当温度升高或降低时，LATTICE CPLD MachXO2的内部晶振的频率是否也会升高或降低，具体关系是怎样的？
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LATTICE CPLD MachXO2规格书中提到的晶振的最大最小值，在电压和温度符合条件的情况下它们是否一直有效？
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LATTICE CPLD MachXO3是否可以通过SPI/ I2C / JTAG之类的编程端口对其SRAM进行重新配置以覆盖已经烧写到NVCM的旧程序？
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6年前发布
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Lattice FPGA MachXO3L上的引脚PB38C和PB38D作为MIPI数据输入。 但是，在运行P＆R（布局布线）时出现以下错误:
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Lattice FPGA用户如何使用DPHYtoCMOS IP的CMOS输出信号作为其他IP或设计的输入？
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6年前发布
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LATTICE FPGA为什么我收到通知，说明我的评估版本Aldec即将到期。 我升级到ispLEVER 7.2，但继续收到Aldec Active-HDL即将过期的通知。
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在Lattice FPGA iCE40器件中可用的编程模式有哪些？
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6年前发布
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LATTICE FPGA所有定义为NC的引脚是否真的没有连接任何东西？ 如果PCB上的走线直接通过MachXO2中的NC引脚互连，会不会有什么问题？
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6年前发布
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在Lattice diamond IPExpress生成的DPRAM HDL文件中使用NGD_DRC_MASK属性是什么用途？
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6年前发布
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当用户逻辑在Lattice FPGA XP2器件中运行时，可以运行软错误检测（SED）模块吗？
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6年前发布
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可以忽略Lattice FPGA iCE40LM 规格书（datasheet）中提到的上电顺序吗？
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6年前发布
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xilinx_fpga
LATTICE FPGA RTL仿真良好、所有的约束也都符合布局线TRACE，但是时序仿真却出现unknowns未知（X）如何解决？
xilinx_fpga
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lattice FPGA 官方的 ecp3 DEMO 在重新配合后会报错“Reference to undefined module ddr_pll ”，请问怎么解决？
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6年前发布
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Lattice cpld MachXO2的VIH_Max是什么意思？
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6年前发布
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LATTICE CPLD MACHXO2-ZE系列（每个速度等级）的IOPAD最高频率是多少？
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6年前发布
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是否可以修改LATTICE CPLD MACHXO2器件的JEDEC文件中所包含的嵌入式块RAM（EBR）的初始化数据？
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6年前发布
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请教当使用LATTICE FPGA 软件 ispVM System 将安全密钥编程到LatticeECP3器件时，出现“无法编程密钥熔丝位。无法继续。”错误，如何解决此问题？
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6年前发布
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lattice cpld MachXO2如何计算PLL配置的CPHASE，FPHASE，ICP_CURRENT，LPF_RESISTOR值？
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6年前发布
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LATTICE有提供Altium Designer的原理图符号库吗？
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6年前发布
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自己画的使用Lattice CrossLink器件的FPGA 板，是否可以使用USB-2B下载线进行编程和配置？
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6年前发布
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如果电路板上的lattice FPGA crosslink器件的 NVCM已编程，如何从外部SPI PROM进行加载？
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6年前发布
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Lattice FPGA crosslink 在MSPI模式下，我可以使用处理器来配置外部SPI引导flash吗？
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如何交换Lattice FPGA CrossLink的硬核D-PHY中的P / N对？
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6年前发布
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latice diamond FPGA软件中tcl文件放在那个路径下才能执行？
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6年前发布
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如何在LATTICE的FPGA器件CrossLink LIFMD器件上使用Reveal来进行工程调试？
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6年前发布
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为什么在Lattice dimaond FPGA软件中使用crosslink的”DPHY to CMOS IP v1.2″时，无法将bank0上的GPIO / IO_port放置在CrossLink中？
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6年前发布
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在Lattice diamond中使用 HW-USBN-2B下载线时，编程速度怎么设置？
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6年前发布
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当我启动LATTICE ispLEVER软件时，最近老是看到下面显示的警告，请问是什么原因？
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6年前发布
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Lattice diamond为什么我无法在Aldec Active-HDL Lattice Edition II中使用切换断点？
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6年前发布
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如何将LATTICE IP LICENSE（许可证）添加到我现有的LATTICE DIAMOND FPGA 软件的LICENSE中？
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6年前发布
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