FPGA CPLD资料源码分享

首页
交流分享
积分规则
创作分成
隐私政策
免责声明
电子工程师在线工具New

发布开通会员

开通黄金会员

全站资源约8折购买
部分内容免费阅读
VIP用户专属版块

开通黄金会员

开通钻石会员

全站资源约6折购买
部分内容免费阅读
VIP用户专属版块
一对一技术指导

开通钻石会员

首页
交流分享
积分规则
创作分成
隐私政策
免责声明
电子工程师在线工具New

开通会员尊享会员权益

FPGA CPLD资料源码分享-ChipDebug

FPGA CPLD资料源码分享

帖子 314互动 377关注 35

FPGA CPLD资料源码分享-ChipDebug

2名版主发布

全部
最新发布
最新回复
热门
精华

等级-LV1-ChipDebug

3年前更新43次阅读

基于 FPGA 实现多路UART/SPI通信系统

第一部分设计概述 /Design Introduction本次的设计为多路UART/SPI通信系统，可以实现一对多的通信。系统可以运行在UART模式，也...

基于 FPGA 实现多路UART/SPI通信系统-ChipDebug

基于 FPGA 实现多路UART/SPI通信系统-ChipDebug

基于 FPGA 实现多路UART/SPI通信系统-ChipDebug

+1

基于 FPGA 实现多路UART/SPI通信系统-ChipDebug

评分

等级-LV4-ChipDebug

3年前更新43次阅读

PCIe扫盲——配置空间的读写机制

PCIe 需要特别注意的是，PCIe的Spec中明确规定只有Root有权限发起配置请求（Originate Configuration Requests），也就是说PCIe系统里...

PCIe扫盲——配置空间的读写机制-ChipDebug

PCIe扫盲——配置空间的读写机制-ChipDebug

评分

等级-LV4-ChipDebug

3年前更新42次阅读

verilog 学习资料分享

该帖子部分内容已隐藏

付费阅读

已售 1

10积分

黄金会员8钻石会员6

此内容为付费阅读，请付费后查看

评分

等级-LV4-ChipDebug

3年前更新40次阅读

PCIe扫盲——PCIe简介

PCIe PCI-Express是继ISA和PCI总线之后的第三代I/O总线，即3GIO。由Intel在2001年的IDF上提出，由PCI-SIG（PCI特殊兴趣组织）认证发...

PCIe扫盲——PCIe简介-ChipDebug

PCIe扫盲——PCIe简介-ChipDebug

PCIe扫盲——PCIe简介-ChipDebug

+2

PCIe扫盲——PCIe简介-ChipDebug

评分

等级-LV4-ChipDebug

3年前更新40次阅读

PCIe扫盲——M-PCIe与MIPI M-PHY

PCIe M-PCIe即Mobile PCIe，主要应用对象是智能手机等嵌入式设备。PCI-SIG在PCIe Spec V3.1中引入基于MIPI M-PHY v2.0的M-PCIe。相比...

PCIe扫盲——M-PCIe与MIPI M-PHY-ChipDebug

PCIe扫盲——M-PCIe与MIPI M-PHY-ChipDebug

PCIe扫盲——M-PCIe与MIPI M-PHY-ChipDebug

+1

PCIe扫盲——M-PCIe与MIPI M-PHY-ChipDebug

评分

等级-LV1-ChipDebug

2年前更新39次阅读

国外FPGA数字设计书籍免费分享

该帖子部分内容已隐藏

付费阅读

已售 2

2积分

黄金会员1钻石会员1

此内容为付费阅读，请付费后查看

评分

等级-LV4-ChipDebug

3年前更新38次阅读

PCIe扫盲——链路初始化与训练基础（三）之LTSSM

PCIe 这一篇文章来简单地介绍一下链路训练状态机（Link Training and Status State Machine，LTSSM），并简要地介绍各个状态的作用和...

PCIe扫盲——链路初始化与训练基础（三）之LTSSM-ChipDebug

PCIe扫盲——链路初始化与训练基础（三）之LTSSM-ChipDebug

PCIe扫盲——链路初始化与训练基础（三）之LTSSM-ChipDebug

+6

PCIe扫盲——链路初始化与训练基础（三）之LTSSM-ChipDebug

评分

等级-LV1-ChipDebug

2年前更新37次阅读

分享几本FPGA项目管理方面的书

该帖子部分内容已隐藏

付费阅读

3积分

黄金会员2钻石会员1

此内容为付费阅读，请付费后查看

1

等级-LV1-ChipDebug

2年前更新37次阅读

国外FPGA数字设计推荐书籍免费下载

该帖子部分内容已隐藏

付费阅读

已售 2

3积分

黄金会员2钻石会员1

此内容为付费阅读，请付费后查看

评分

等级-LV4-ChipDebug

3年前更新37次阅读

PCIe扫盲——PCIe卡Spec（CEM）导读

PCIe 前面的文章介绍过，PCIe总线除了有Base Spec，还有关于PCIe卡的Spec（又称为CEM Spec，全称为PCI Express Card Electromechanica...

PCIe扫盲——PCIe卡Spec（CEM）导读-ChipDebug

PCIe扫盲——PCIe卡Spec（CEM）导读-ChipDebug

PCIe扫盲——PCIe卡Spec（CEM）导读-ChipDebug

+5

PCIe扫盲——PCIe卡Spec（CEM）导读-ChipDebug

1

等级-LV1-ChipDebug

2年前更新37次阅读

FPGA实现多通道数据整形器（MCDF）verilog设计（一）——通道从端模块 (slave_fifo)

文章目录一、MCDF设计要求二、通道从端模块 (slave_fifo) 1、原理分析 2、设计思路 3、结果分析
一、MCDF设计要求
多通道数据...

FPGA实现多通道数据整形器（MCDF）verilog设计（一）——通道从端模块 (slave_fifo)-ChipDebug

FPGA实现多通道数据整形器（MCDF）verilog设计（一）——通道从端模块 (slave_fifo)-ChipDebug

FPGA实现多通道数据整形器（MCDF）verilog设计（一）——通道从端模块 (slave_fifo)-ChipDebug

+1

FPGA实现多通道数据整形器（MCDF）verilog设计（一）——通道从端模块 (slave_fifo)-ChipDebug

1

等级-LV1-ChipDebug

2年前更新37次阅读

Altera FPGA／CPLD设计基础篇高级篇(第2版）及光盘下载

该帖子部分内容已隐藏

付费阅读

已售 1

3积分

黄金会员2钻石会员1

此内容为付费阅读，请付费后查看

评分

等级-LV4-ChipDebug

3年前更新36次阅读

Verilog数字系统设计教程夏宇闻第3版.pdf

该帖子部分内容已隐藏

付费阅读

3积分

黄金会员2钻石会员1

此内容为付费阅读，请付费后查看

评分

等级-LV2-ChipDebug

3年前更新36次阅读

上传个老物件，82c54的cpld/FPGA实现源码及设计文档

该帖子部分内容已隐藏

付费阅读

3积分

黄金会员2钻石会员1

此内容为付费阅读，请付费后查看

2

等级-LV1-ChipDebug

3年前更新35次阅读

qpsk调制的FPGA实现详解

该帖子内容已隐藏

付费阅读

10积分

黄金会员8钻石会员6

此内容为付费阅读，请付费后查看

评分

等级-LV4-ChipDebug

3年前更新35次阅读

PCIe扫盲——基于WinDriver快速开发PCIe驱动简明教程

PCIe 本文将简要介绍如何使用Jungo公司的WinDriver工具快速开发PCI Express设备驱动，以及相关注意事项。本文所使用的的测试平台信息...

PCIe扫盲——基于WinDriver快速开发PCIe驱动简明教程-ChipDebug

PCIe扫盲——基于WinDriver快速开发PCIe驱动简明教程-ChipDebug

PCIe扫盲——基于WinDriver快速开发PCIe驱动简明教程-ChipDebug

+11

PCIe扫盲——基于WinDriver快速开发PCIe驱动简明教程-ChipDebug

评分

等级-LV4-ChipDebug

3年前更新35次阅读

以太网扫盲——64b/66b编码

64b/66b编码技术是IEEE 802.3工作组为10G以太网提出的，目的是减少编码开销，降低硬件的复杂性，并作为8b/10b编码的另一种选择，...

以太网扫盲——64b/66b编码-ChipDebug

以太网扫盲——64b/66b编码-ChipDebug

以太网扫盲——64b/66b编码-ChipDebug

+1

以太网扫盲——64b/66b编码-ChipDebug

评分

等级-LV4-ChipDebug

3年前更新34次阅读

基于FPGA的嵌入式图像处理系统设计_原魁[译].pdf

该帖子部分内容已隐藏

付费阅读

10积分

黄金会员8钻石会员6

此内容为付费阅读，请付费后查看

评分

等级-LV2-ChipDebug

3年前发布34次阅读

FPGA CPLD应用设计200例.pdf

该帖子部分内容已隐藏

付费阅读

3积分

黄金会员2钻石会员1

此内容为付费阅读，请付费后查看

评分

等级-LV2-ChipDebug

3年前发布33次阅读

【论文推荐】基于FPGA的人体行为识别系统的设计

该帖子部分内容已隐藏

付费阅读

1积分

黄金会员免费钻石会员免费

此内容为付费阅读，请付费后查看

1

等级-LV1-ChipDebug

2年前更新33次阅读

数字设计相关电子书（补发）

该帖子部分内容已隐藏

付费阅读

3积分

黄金会员2钻石会员1

此内容为付费阅读，请付费后查看

评分

等级-LV4-ChipDebug

3年前发布33次阅读

2048点FFT verilog 源码

该帖子内容已隐藏，请评论后查看

登录后继续评论

评分

等级-LV1-ChipDebug

2年前更新32次阅读

分享两本FPGA时序分析精典英文书籍资料

该帖子内容已隐藏

付费阅读

3积分

黄金会员2钻石会员1

此内容为付费阅读，请付费后查看

评分

等级-LV4-ChipDebug

3年前更新32次阅读

PCIe扫盲——PCI总线的三种传输模式

PCIe 本文来简单地介绍一下PCI Spec规定的三种数据传输模型：Programmed I/O（PIO），Peer-to-Peer和DMA。
三种数据传输模型的示意图...

PCIe扫盲——PCI总线的三种传输模式-ChipDebug

评分

等级-LV4-ChipDebug

3年前更新32次阅读

Lattice CrossLink-NX/Certus-NX FPGA 对PCIe的支持

PCIe 本文主要介绍Lattice近期发布的两款芯片对PCIe协议的支持，以及相关IP的使用方法和注意事项。
Lattice在19年底，发布了业界首款...

Lattice CrossLink-NX/Certus-NX FPGA 对PCIe的支持-ChipDebug

Lattice CrossLink-NX/Certus-NX FPGA 对PCIe的支持-ChipDebug

Lattice CrossLink-NX/Certus-NX FPGA 对PCIe的支持-ChipDebug

+1

Lattice CrossLink-NX/Certus-NX FPGA 对PCIe的支持-ChipDebug

评分

等级-LV4-ChipDebug

3年前更新31次阅读

PCIe扫盲——BDF与配置空间

PCIe 前面的文章中介绍过，每一个PCIe设备可以只有一个功能（Function），即Fun0。也可以拥有最多8个功能，即多功能设备（Multi-Fun）...

PCIe扫盲——BDF与配置空间-ChipDebug

PCIe扫盲——BDF与配置空间-ChipDebug

PCIe扫盲——BDF与配置空间-ChipDebug

评分

等级-LV4-ChipDebug

3年前更新30次阅读

用于verilog VHDL代码检测的工具，Windows 版 nLint 22v24和谐办法

该帖子部分内容已隐藏

付费阅读

3积分

黄金会员2钻石会员1

此内容为付费阅读，请付费后查看

评分

等级-LV4-ChipDebug

3年前更新30次阅读

PCIe扫盲——TLP Header详解（一）

PCIe 事务层包（TLP）的一般格式如下图所示：
前面的文章介绍过，TLP Header为3DW或者4DW，Data Payload为1-1024DW，最后的TLP Digest...

PCIe扫盲——TLP Header详解（一）-ChipDebug

PCIe扫盲——TLP Header详解（一）-ChipDebug

PCIe扫盲——TLP Header详解（一）-ChipDebug

+2

PCIe扫盲——TLP Header详解（一）-ChipDebug

评分

等级-LV1-ChipDebug

3年前更新30次阅读

基于FPGA的直接扩频通信系统设计（附代码）

导读本篇适用于有一定通信基础的大侠，本篇使用的理论不仅仅是扩频通信。为了便于学习，本篇只把设计中使用的理论进行说明讲解。...

基于FPGA的直接扩频通信系统设计（附代码）-ChipDebug

基于FPGA的直接扩频通信系统设计（附代码）-ChipDebug

基于FPGA的直接扩频通信系统设计（附代码）-ChipDebug

+24

基于FPGA的直接扩频通信系统设计（附代码）-ChipDebug

评分

等级-LV1-ChipDebug

2年前更新29次阅读

基于FPGA的VGA/LCD显示控制器设计附代码

该帖子部分内容已隐藏

付费阅读

3积分

黄金会员2钻石会员1

此内容为付费阅读，请付费后查看

评分

上一页 1 2 345 6…11 下一页跳转

35人已关注

FPGA CPLD资料源码分享-ChipDebug

FPGA CPLD资料源码分享

帖子

314

互动

377

阅读

1.8W+

搜索

开启精彩搜索

FPGA SOC ARM RISCV IC 开发调试技术交流分享

FPGA SOC ARM RISCV IC 开发调试技术交流分享

FPGA SOC ARM RISCV IC 开发调试技术交流分享

FPGA SOC ARM RISCV IC 开发调试技术交流分享

FPGA SOC ARM RISCV IC 开发调试技术交流分享

FPGA SOC ARM RISCV IC 开发调试技术交流分享

最新的帖子

chipdebug是一个专业的芯片开发调试分享社区，这里是电子工程师分享开发资料，调试经验的社区。
合作、删帖请联系 admin@chipdebug.com
Copyright © 2022 · ChipDebug · 由 ChipDebug 强力驱动.

在手机上浏览此页面

登录

没有账号？立即注册

邮箱

验证码

记住登录账号密码登录

用户名/手机号/邮箱

登录密码

记住登录找回密码 | 免密登录

注册

已有账号，立即登录

设置用户名

手机号或邮箱

验证码

设置密码

重复密码

注册即表示同意用户协议、隐私声明

欢迎光临！

ChipDebug入站需知

本站无广告也无付费项目，如发现帐号发垃圾帖或评论的一律封号！

ChipDebug是一个芯片开发调试分享网站
欢迎您的到来！如果您没有帐户请先点击下方按钮进行注册

登录注册找回密码积分规则