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FPGA CPLD
Lattice-莱迪斯
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莱迪思半导体公司是美国的一家半导体公司，专门从事低功耗，现场可编程门阵列的设计和制造。
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xilinx_fpga
LATTICE FPGA软件diamond请问在哪里设置Verilog的版本？
xilinx_fpga
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LATTICE FPGA map的时候出现错误 “IO register/latch … annot be implemented in PIC.”
ipqsn
6年前发布
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ipqsn
LATTICE FPGA综合参数时报警告 unsupported property怎么解决？
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ipqsn
28天前回复
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ipqsn
lattice的FIFO full信号好像是有bug？ 既空又满。
ipqsn
6年前发布
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ipqsn
lattice fpga之前好好的，为什么改变一下管脚分配就会出现”required array inputs exceed the limit of 36″？
ipqsn
6年前发布
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ipqsn
LATTICE FPGA serdes的第三种Loopback paralel data after de-serialzer外环好像无效?
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ipqsn
6年前发布
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xilinx_fpga
LATTICE FPGA的嵌入式逻辑分析仪reveal错误“core incorrect response”怎么解决？
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xilinx_fpga
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xilinx_fpga
LATTICE FPGA 软件DIAMOND编译mipi csi错误 “ERROR – logical block … is unexpanded”怎么办？
xilinx_fpga
6年前发布
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xilinx_fpga
lattice的USB3.0 3014方案，对于MAC LINUX WINDOWS系统下，USB的固件是不是需要改动还是说都能支持？
xilinx_fpga
6年前发布
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52fpga
为什么lattice FPGA 的参考设计里面，有的模块怎么只有端口，没有逻辑描述呢？
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52fpga
6年前发布
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52fpga
请教下 win10 lattice 开发环境那个比较好?
52fpga
6年前发布
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52fpga
请问LATTICE FPGA的ROHS报告在哪里可以查到？
52fpga
6年前发布
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52fpga
LATTICE CPLD LC4064V-75TN48C SMT贴片出现较多虚焊，请问该怎么解决？
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52fpga
6年前发布
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52fpga
LATTICE的 XO2-4000 CPLD，是只有bank0的脚才能lvds输出吗？
52fpga
6年前发布
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pipisan
LATTICE FPGA 在diamond软件中使用源语时提示“instantiating unknown module VLO”错误，怎么解决？
pipisan
6年前发布
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pipisan
LATTICE FPGA 软件diamond 调用源语 OB， 结果出现 illegal pad connections 的错误提示，请问怎么解决？
pipisan
6年前发布
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xilinx_fpga
请教LATTICE CPLD XO2 的LVDS怎么使用？
xilinx_fpga
6年前发布
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popomao
LATTICE FPGA 软件 diamond里面，Verilog 和 vhdl可以混合调用吧？
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popomao
1年前回复
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52fpga
LATTICE CPLD 软件 DIAMOND 报错” ERROR – osc_clk matches no clock nets in the design.”怎么解决啊 ?
1
52fpga
6年前发布
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pipisan
lattice FPGA软件diamond 报错“external connection to net gnd is not allowed”怎么办？
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pipisan
6年前发布
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pipisan
请问LATTICE FPGA软件DIAMOND时序约束中的PAR_ADJ和Hold margin是什么含意,该怎么设置？
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pipisan
6年前发布
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52fpga
MCU对LATTICE XO2\XO3的CPLD进行I2C配置加载有时会出现读取ID失败，需要JTAG激活，求助！
52fpga
6年前发布
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popomao
LATTICE官网关于MIPI的参考原理图在哪里？
popomao
6年前发布
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52fpga
怎样提升LATTICE FPGA CPLD的下载烧录速度，让FPGA的下载更快更省时间？
52fpga
6年前发布
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52fpga
LATTICE ECP5 FPGA LVDS收发出错，请问是什么原因怎么解决？
52fpga
6年前发布
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lzh
LATTICE CPLD XO3做SPI收发，最快能做到多高的频率，96M可以吗？
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lzh
6年前发布
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lzh
LATTICE CPLD XO3芯片bank0可以作为7:1LVDS的差分输入吗？还是只能作为输出？
lzh
6年前发布
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52fpga
XO2烧录JED的时候一直烧录不成功，显示不能正确读取器件ID，怎么解决？
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52fpga
6年前发布
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52fpga
为什么LATTICE的scaler缩放 IP采用动态配置效果没有固定分辨率效果好?
52fpga
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fuckfpga
lattice的crosslink FPGA的MIPI硬核怎么修改D-PHY的位置
fuckfpga
6年前发布
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