FPGA常见问题社区-FPGA常见问题版块-FPGA CPLD-ChipDebug
FPGA常见问题-ChipDebug
分享
FPGA CPLD

FPGA常见问题

帖子 613互动 404关注 54
FPGA常见问题，如仿真，时序，设计思路等。
FPGA常见问题-ChipDebug
chipdebug的头像-ChipDebuginner的头像-ChipDebug2名版主发布
JinZhong的头像-ChipDebugJinZhong徽章-初出茅庐-ChipDebug等级-LV1-ChipDebug

国产FPGA推荐

JinZhong徽章-初出茅庐-ChipDebug等级-LV1-ChipDebug1年前回复
3720
Lanneret36的头像-ChipDebugLanneret36等级-LV1-ChipDebug

ISE开发FPGA时以原理图为顶层设计，突然间打不开顶层文件1

Lanneret36等级-LV1-ChipDebug1年前发布
400
starkwang的头像-ChipDebugstarkwang等级-LV1-ChipDebug

关于FPGA中锁存器的生成：if语句和case语句的完整性影响5

starkwang等级-LV1-ChipDebug1年前发布
2900
eurkidu的头像-ChipDebugeurkidu徽章-元老玩家-ChipDebug等级-LV1-ChipDebug

FPGA复位信号设计讨论3

eurkidu徽章-元老玩家-ChipDebug等级-LV1-ChipDebug2年前发布
2600
Poison的头像-ChipDebugPoison等级-LV2-ChipDebug

【手把手系列】：芯片设计中的Makefile简明教程

Poison等级-LV2-ChipDebug2年前发布
3200
Poison的头像-ChipDebugPoison等级-LV2-ChipDebug

跨时钟域的几种基本处理方法2

Poison等级-LV2-ChipDebug2年前发布
4200
Poison的头像-ChipDebugPoison等级-LV2-ChipDebug

AXI4协议逻辑规范以及BUG处理1

Poison等级-LV2-ChipDebug2年前发布
2500
mdy-吴伟杰的头像-ChipDebugmdy-吴伟杰等级-LV1-ChipDebug

如何设计FPGA干净的代码

mdy-吴伟杰等级-LV1-ChipDebug5年前发布
33500
Jackle910的头像-ChipDebugJackle910等级-LV1-ChipDebug

FPGA数字图像显示原理与实现(Verilog)11

Jackle910等级-LV1-ChipDebug1年前发布
11300
yinhk的头像-ChipDebugyinhk等级-LV1-ChipDebug

【FPGA基础】同步复位与异步复位

yinhk等级-LV1-ChipDebug1年前发布
1701
LuckyHH的头像-ChipDebugLuckyHH等级-LV1-ChipDebug

基于线性序列机实现的FPGA 通过SPI协议读写winbond公司flash芯片25Q162

LuckyHH等级-LV1-ChipDebug1年前发布
1200
Simeone_xu的头像-ChipDebugSimeone_xu等级-LV2-ChipDebug

GD32F470系列1：调用EXMC与FPGA通信实例4

Simeone_xu等级-LV2-ChipDebug1年前发布
21900
showkevin的头像-ChipDebugshowkevin等级-LV2-ChipDebug

FPGA之锁相环4种模式5

showkevin等级-LV2-ChipDebug1年前发布
1900
boxFPGA的头像-ChipDebugboxFPGA等级-LV1-ChipDebug

FPGA ISP Bayer与常见颜色空间转换16

boxFPGA等级-LV1-ChipDebug1年前发布
5600
Mr_taotie的头像-ChipDebugMr_taotie等级-LV1-ChipDebug

中科大FPGA OL应用：数据选择器、跑马灯

Mr_taotie等级-LV1-ChipDebug1年前发布
600
Mr_taotie的头像-ChipDebugMr_taotie等级-LV1-ChipDebug

FPGA同步时序电路设计12

Mr_taotie等级-LV1-ChipDebug1年前发布
1900
xilinx_wiki的头像-ChipDebugxilinx_wiki等级-LV2-ChipDebug

【计算机组织与体系结构及其FPGA实现】实验一：算术逻辑单元的实现5

xilinx_wiki等级-LV2-ChipDebug1年前发布
3100
xilinx_wiki的头像-ChipDebugxilinx_wiki等级-LV2-ChipDebug

【计算机组织与体系结构及其FPGA实现】实验二：给定指令系统的处理器设计49

xilinx_wiki等级-LV2-ChipDebug1年前发布
7800
xilinx_wiki的头像-ChipDebugxilinx_wiki等级-LV2-ChipDebug

【计算机组织与体系结构及其FPGA实现】实验三：流水线处理器13

xilinx_wiki等级-LV2-ChipDebug1年前发布
4200
xilinx_wiki的头像-ChipDebugxilinx_wiki等级-LV2-ChipDebug

【计算机组织与体系结构及其FPGA实现】实验四：指令 CACHE 的设计与实现19

xilinx_wiki等级-LV2-ChipDebug1年前发布
49800
starkwang的头像-ChipDebugstarkwang等级-LV1-ChipDebug

Verilog实现带暂停和刷新的四级流水线加法器3

starkwang等级-LV1-ChipDebug1年前回复
7310
Harman的头像-ChipDebugHarman徽章-创作大使-ChipDebug等级-LV1-ChipDebug

VHDL实现动态数码管驱动2

Harman徽章-创作大使-ChipDebug等级-LV1-ChipDebug1年前发布
900
Harman的头像-ChipDebugHarman徽章-创作大使-ChipDebug等级-LV1-ChipDebug

FPGA：组合逻辑电路的设计5

Harman徽章-创作大使-ChipDebug等级-LV1-ChipDebug1年前发布
700
Harman的头像-ChipDebugHarman徽章-创作大使-ChipDebug等级-LV1-ChipDebug

Verilog:模块结构/assign/always[学习笔记day3]2

Harman徽章-创作大使-ChipDebug等级-LV1-ChipDebug1年前发布
500
Ordinary的头像-ChipDebugOrdinary徽章-元老玩家-ChipDebug等级-LV1-ChipDebug

基于FPGA高精度NTP时钟授时方法研究

Ordinary徽章-元老玩家-ChipDebug等级-LV1-ChipDebug10个月前回复
6010
weakish的头像-ChipDebugweakish等级-LV1-ChipDebug

FPGA与数字IC知识点（一）

weakish等级-LV1-ChipDebug1年前发布
3600
vishva的头像-ChipDebugvishva等级-LV2-ChipDebug

JESD204B接口调试记录20

vishva等级-LV2-ChipDebug1年前发布
6800
Airkids_zz的头像-ChipDebugAirkids_zz等级-LV1-ChipDebug

AMBA–AHB总线协议学习及Verilog实现与仿真（一）13

Airkids_zz等级-LV1-ChipDebug1年前发布
9500
forkwave的头像-ChipDebugforkwave等级-LV2-ChipDebug

verilog小技巧之深度转化为位宽的function

forkwave等级-LV2-ChipDebug1年前发布
1500
forkwave的头像-ChipDebugforkwave等级-LV2-ChipDebug

Verilog：parameter、localparam的区别和用法

forkwave等级-LV2-ChipDebug1年前发布
3700
12345…21跳转

分享
FPGA常见问题-ChipDebug

FPGA常见问题

FPGA常见问题，如仿真，时序，设计思路等。
发布
帖子
613
互动
404
阅读
5.1W+
搜索
开启精彩搜索
FPGA SOC ARM RISCV IC 开发调试技术交流分享
FPGA SOC ARM RISCV IC 开发调试技术交流分享
FPGA SOC ARM RISCV IC 开发调试技术交流分享
FPGA SOC ARM RISCV IC 开发调试技术交流分享
FPGA SOC ARM RISCV IC 开发调试技术交流分享
FPGA SOC ARM RISCV IC 开发调试技术交流分享

最新的帖子

在手机上浏览此页面