首页
交流分享
积分规则
创作分成
隐私政策
免责声明
电子工程师在线工具
New
发布
开通会员
开通黄金会员
全站资源约8折购买
部分内容免费阅读
VIP用户专属版块
开通黄金会员
开通钻石会员
全站资源约6折购买
部分内容免费阅读
VIP用户专属版块
一对一技术指导
开通钻石会员
开通会员 尊享会员权益
登录
注册
找回密码
首页
交流分享
积分规则
创作分成
隐私政策
免责声明
电子工程师在线工具
New
开通会员 尊享会员权益
登录
注册
找回密码
分享
FPGA CPLD
Xilinx-AMD
帖子 1.1W+
互动 466
关注 136
赛灵思是FPGA、可编程SoC及ACAP的发明者, 其高度灵活的可编程芯片由一系列先进的软件和工具提供支持,可推动跨行业和多种技术的快速创新- 从消费电子类到汽车类再到云端。
超级版主
发布
全部
最新发布
最新回复
热门
精华
xilinx_wiki
LogICORG千兆以太网MAC V2.1在版本2.1中有什么新的?
xilinx_wiki
7年前发布
4
0
0
xilinx_wiki
McBLASZE – OPB CLK可以运行在不同的频率比MixBRACE核心时钟?
xilinx_wiki
7年前发布
4
0
0
xilinx_wiki
VelTEX II职业ROKETIO -我如何确保我的设计不会溢出或下溢的RX(接收器)弹性缓冲区,因为RX/TX时钟差异(时钟校正)?
xilinx_wiki
7年前发布
71
0
0
xilinx_wiki
MimSimultXilinx版(MXE)-当没有管理员权限的用户登录时发生许可证错误
xilinx_wiki
7年前发布
1
0
0
xilinx_wiki
UNIX——我如何执行递归GRIP?如何在给定目录和所有子目录中搜索文件中的文本?
xilinx_wiki
7年前发布
1
0
0
xilinx_wiki
5.2i xPOWER输出负载未从XPUT设置文件保存/恢复
xilinx_wiki
7年前发布
1
0
0
xilinx_wiki
5.1i时序分析器-未正确分析偏移量约束的BufGMUX选择行
xilinx_wiki
7年前发布
4
0
0
xilinx_wiki
5.1i时序分析器-在时序分析器中产生的新时序报告窗口中出现显示问题
xilinx_wiki
7年前发布
6
0
0
xilinx_wiki
61i CPLD TAEngine -fitter重命名和重写偏移定时约束:从:到约束
xilinx_wiki
7年前发布
2
0
0
xilinx_wiki
MyBLASZE——使用HDL库构建自己的OPB外围器件
xilinx_wiki
7年前发布
3
0
0
xilinx_wiki
61i时序分析器-时序报告不允许我向下拖动滚动条
xilinx_wiki
7年前发布
12
0
0
xilinx_wiki
LogICORG千兆以太网MAC -统计寄存器可以清除/重置吗?
xilinx_wiki
7年前发布
12
0
0
xilinx_wiki
VelTEX II PROKYTIOO -接收(RX)弹性缓冲区的大小是多少?
2
xilinx_wiki
7年前发布
10
0
0
xilinx_wiki
DSP的6.2系统发生器-为什么希尔伯特变换版本的DA FIR CORGEN核心不可用在SysGEN?
xilinx_wiki
7年前发布
4
0
0
xilinx_wiki
LogICORG千兆以太网MAC V2.1 -何时RXY-GODYFrAM/RXYBADYGRID的断言发生在RXYDATAORID有效的断言?
3
xilinx_wiki
7年前发布
3
0
0
xilinx_wiki
4.2i速度文件- VelTEX II PRO的新速度文件已经发布(2002年6月14日)
xilinx_wiki
7年前发布
2
0
0
xilinx_wiki
5.1IXPOWER -“警告:电源:91 -不能改变净环球逻辑092到110兆赫的频率”
xilinx_wiki
7年前发布
4
0
0
xilinx_wiki
7.1IXST——设计计数器的已知问题
xilinx_wiki
7年前发布
5
0
0
xilinx_wiki
由于不同的S/R信号,3.3I/62I/61I XST-MAP拒绝IOB寄存器包。
xilinx_wiki
7年前发布
6
0
0
xilinx_wiki
2.2微闪存,XMD -“错误:XMD EXE已产生错误,并将关闭Windows”后出现在硬件模式后,ISE 4.2I SP 3安装
xilinx_wiki
7年前发布
2
0
0
xilinx_wiki
5.1i体系结构向导,RokTio向导-“错误:位置-组件BrFLKKYBLK3没有站点可以放置。”
xilinx_wiki
7年前发布
1
0
0
xilinx_wiki
5.1i约束编辑器-添加一个句柄约束会导致“错误:XMelHelp: 664周期规范……”
xilinx_wiki
7年前发布
1
0
0
xilinx_wiki
1.1i ViTEX II映射时序工具可以通过F5MUX标记错误路径
xilinx_wiki
7年前发布
4
0
0
xilinx_wiki
LogiLog-FFT -仿真所有固定网表FFT(64, 256, 1024)核产生许多警告
xilinx_wiki
7年前发布
7
0
0
xilinx_wiki
系统ACE CF -您如何专门选择配置数据源为CF、MPU或JTAG?(需要在数据表V1.5中澄清表27)
xilinx_wiki
7年前发布
34
0
0
xilinx_wiki
5.1i,DCM向导-如果我选择StastupIWAWE属性,仍然需要设置LCKI循环BITGEN选项吗?
xilinx_wiki
7年前发布
3
0
0
xilinx_wiki
5.2i XPOWER——“FATALOLIGROUP:POWER:YTAB。C:1567:1.157.4-POWER VCDCH解析器……”
xilinx_wiki
7年前发布
3
0
0
xilinx_wiki
5.1i核心生成器——5.1i软件发布中核心生成器的已知问题
xilinx_wiki
7年前发布
6
0
0
xilinx_wiki
LogICORSPI4.2(POSPHY L4)V4.x运行BITGEN导致“错误:设计规则:524 -块检查:不完整的DCM配置……”
xilinx_wiki
7年前发布
6
0
0
xilinx_wiki
LogICORSPI4.2(POSP-PHYL4)V4.x-当发送奇数大小的数据包时,发射机不能将16位PL4总线字的无效字节清零。
xilinx_wiki
7年前发布
3
0
0
上一页
1
…
170
171
172
173
174
…
368
下一页
跳转
136人已关注
分享
Xilinx-AMD
赛灵思是FPGA、可编程SoC及ACAP的发明者, 其高度灵活的可编程芯片由一系列先进的软件和工具提供支持,可推动跨行业和多种技术的快速创新- 从消费电子类到汽车类再到云端。
发布
关注
帖子
1.1W+
互动
466
阅读
27.7W+
搜索
开启精彩搜索
最新的帖子
在手机上浏览此页面
登录
没有账号?立即注册
邮箱
验证码
发送验证码
记住登录
账号密码登录
登录
用户名/手机号/邮箱
登录密码
记住登录
找回密码
|
免密登录
登录
注册
已有账号,立即登录
设置用户名
手机号或邮箱
验证码
发送验证码
设置密码
重复密码
注册
注册即表示同意
用户协议
、
隐私声明
欢迎光临!
ChipDebug入站需知
本站无广告也无付费项目,如发现帐号发垃圾帖或评论的一律封号!
ChipDebug是一个芯片开发调试分享网站
欢迎您的到来!如果您没有帐户请先点击下方按钮进行
注册
登录
注册
找回密码
积分规则