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chipdebug
2年前更新
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PCIe扫盲——中断机制介绍（INTx）
PCIe
一个简单的PCI总线INTx中断实现流程，如下图所示。
1. 首先，PCI设备通过INTx边带信号产生中断请求，经过中断控制器（In...
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XYShaoKang
1年前更新
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时序分析相关书籍
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eurkidu
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时序约束电子书（补发）
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chipdebug
2年前更新
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PCIe扫盲——Base Limit寄存器详解
PCIe
上一篇文章介绍了Type0型配置空间Header中的BAR的作用和用法，但是PCIe中的桥设备（Switch和Root中的P2P）又是如何判断某一请求...
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chipdebug
1年前更新
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emwin 5.06a 全部源码分享
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Shurlormes
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纯FPGA实现收音机的源码分享
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Shurlormes
1年前发布
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weakish
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FPGA经典开源项目
之前在github（https://github.com/troyguo/awesome-dv）上整理了一些开源的芯片类的项目，收获了很多人的点赞。这里再次拿出来分享给大家一起学习，共同进步，也欢迎大家到github上点star，或者有好的项目也欢迎提PR。Design/VerificationProjectIbex: http...
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chipdebug
2年前更新
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PCIe扫盲——TLP路由（Routing）基础
PCIe
首先来分析一个例子，如下图所示：
当包（Packet）到达Switch的输入端口（Ingress Port）时，端口首先会检查包是否有错误，然后...
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chipdebug
2年前更新
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PCIe扫盲——中断机制介绍（MSI）
PCIe
前面的文章中介绍过，MSI本质上是一种Memory Write，和PCIe总线中的Message概念半毛钱关系都没有。并且，MSI的Data Payload也是...
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vishva
2年前更新
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UCOSIII在ZYNQ上教程
在ZYNQ上移植UCOSIII版本：Vivado2018.3UCOS对Xilinx SDK适配的版本：Version1.45注意：目前这个是Micrium官网的最新版本，该版...
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popomao
1年前发布
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用cpld实现MAX3100的verilog源码分享
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popomao
1年前发布
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ADPCM 压缩解压 原理、c代码、verilog代码和quartus工程
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chipdebug
2年前更新
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PCIe扫盲——TLP路由之ID Routing
PCIe
ID 路由（ID Routing）有的时候也被称为BDF路由，即采用Bus Number、Device Number和Function Number来确定目标设备的位置。这是...
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chipdebug
2年前更新
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PCIe扫盲——复位机制介绍（Fundamental Hot）
PCIe
PCIe总线中定义了四种复位名称：冷复位（Cold Reset）、暖复位（Warm Reset）、热复位（Hot Reset）和功能层复位（Function-Leve...
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chipdebug
2年前更新
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PCIe扫盲——TLP路由之Address Routing
PCIe
地址路由（Address Routing）的地址包括IO和Memory。对于Memory请求来说，32bit的地址使用3DW的Header，64bit的地址使用4DW的Hea...
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chipdebug
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PCIe扫盲——复位机制介绍（FLR）
PCIe
PCIe总线自V2.0加入了功能层复位（Function Level Reset，FLR）的功能。该功能主要针对的是支持多个功能的PCIe设备（Multi-Fun P...
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chipdebug
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PCIe扫盲——TLP路由之Implicit Routing
PCIe
模糊路由（Implicit Routing，又译为隐式路由）只能用于Message的路由。前面的文章中多次提到过，PCIe总线相对于PCI总线的一大改...
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chipdebug
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PCIe扫盲——热插拔简要介绍
PCIe
某些特殊的应用场合可能要求PCIe设备能够以高可靠性持续不间断运行，为此，PCIe总线采用热插拔（Hot Plug）和热切换（Hot Swap）...
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chipdebug
2年前更新
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PCIe扫盲——PCI Express物理层接口（PIPE）
PCIe
PCIe物理层接口（Physical Interface for PCI Express，PIPE）定义了物理层中的，媒介层（Media Access Layer，MAC）和物理编码...
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chipdebug
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PCIe扫盲——弹性缓存（Elastic Buffer/ CTC Buffer）
PCIe
前面在介绍PCIe物理层逻辑子层的文章中，有提到过弹性缓存（Elastic Buffer，又称为CTC Buffer或者Synchronization Buffer）...
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52fpga
2年前发布
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ZYNQ的核心板原理图和PCB, The_Zynq_Book_ebook 中文和英文版.pdf 分享
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chipdebug
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PCIe扫盲——TLP Header详解（一）
PCIe
事务层包（TLP）的一般格式如下图所示：
前面的文章介绍过，TLP Header为3DW或者4DW，Data Payload为1-1024DW，最后的TLP Digest...
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52fpga
2年前更新
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FPGA实现 BT1120 必读文档，BT1120 协议规范
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chipdebug
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PCIe扫盲——PCIe配置空间寄存器快速定位表
PCIe
PCI Express的配置空间结构图如下图所示，为了能够快速定位相关寄存器的描述在PCIe Spec中的位置，整理了一个表格，顺便分享到我...
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Ordinary
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Altera USB Blaster,J-Link,ST-Link,CMSIS-DAP多合一下载器开源
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chipdebug
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PCIe扫盲——Power Management概述（一）
PCIe
PCIe总线定义的与功耗管理功能（Power Management，PM）相关的主要有：PCI-Compatible PM、Native PCIe Extensions、Bandwith Ma...
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chipdebug
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chipdebug
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UBM V1.4 协议
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chipdebug
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Cordic算法FPGA实现cos,sin (含python和verilog代码)
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