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popomao
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lattice xo3 LVDS 7:1 源码工程示例
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PCIe扫盲——PCIe总线数据链路层入门
PCIe
前面的文章介绍过，数据链路层（Data Link Layer）主要进行链路管理（Link Management）、TLP错误检测，Flow Control和Link功耗...
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华为Synplify快速入门.pdf
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华为 海思coding style.doc 海思高校合作——QA培训资料 RTL CODE 规范
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华为FPGA设计流程指南.doc
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华为VHDL设计风格和实现.ppt
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华为_大规模逻辑设计指导书.pdf
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PCIe扫盲——PCIe总线物理层入门
PCIe
前面的文章简单的介绍了一些关于PCIe总线事务层（Transaction Layer）和数据链路层（Data Link Layer）的一些基本概念。这篇文...
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chipdebug
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华为同步电路设计规范.pdf 密码：openfree
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yzllee
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基于 FPGA 的视频流人脸伪造设备
第一部分 设计概述（Design Introduction）
1.1 设计目的
近年来随着机器学习等技术的发展，人工智能在图像识别、语音处理等方...
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FPGA学习精品资料汇总帖
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华为以太网时钟同步技术——时钟透传技术白皮书.pdf
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华为硬件工程师手册_全.pdf
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华为专利一种将异步时钟域转换成同步时钟域的方法.pdf
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PCIe扫盲——一个Memory Read操作的例子
PCIe
前面的一系列文章简要地介绍了PCIe总线的结构、事务层、数据链路层和物理层。下面我们用一个简单地的例子来回顾并总结一下。
如...
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chipdebug
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华为上研硬件BTS 静态时序分析与逻辑…pdf
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华为 Verilog典型电路设计.pdf
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华为 FPGA设计高级技巧 Xilinx篇.pdf
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PCIe扫盲——BDF与配置空间
PCIe
前面的文章中介绍过，每一个PCIe设备可以只有一个功能（Function），即Fun0。也可以拥有最多8个功能，即多功能设备（Multi-Fun）...
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chipdebug
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PCIe扫盲——高级错误报告AER（一）
PCIe
前面的文章提到过高级错误报告（Advanced Error Reporting，AER），接下来详细地介绍一下这一功能。在已有的PCIe错误报告机...
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华为 Verilog HDL入门教程.pdf
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华为FPGA设计规范.doc
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全网最全PCIE学习资料免费分享，FPGA实现PCIE必读文档！
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PCIe扫盲——高级错误报告AER（二）
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这一篇文章讲一讲，高级错误报告（Advanced Error Reporting，AER）关于可校正和不可校正错误的相关寄存器，以及Root如何处理来...
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chipdebug
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PCIe扫盲——配置空间的读写机制
PCIe
需要特别注意的是，PCIe的Spec中明确规定只有Root有权限发起配置请求（Originate Configuration Requests），也就是说PCIe系统里...
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vishva
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学习网站汇总
今天给大家推荐几个有趣的网站1、Z-library这个网站书多，想要搜的书基本都能找到（英文书），目前淘宝或者咸鱼卖的书很多都是出...
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PCIe扫盲——Type0 Type1 型配置请求
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前面的文章中介绍过有两种类型的配置空间，Type0和Type1，分别对应非桥设备（Endpoint）和桥设备（Root和Switch端口中的P2P桥）...
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PCIe扫盲——两种中断传递方式
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为了能够让一些优先级高的事务得到优先处理，PCI总线支持外设中断用以提高总线性能。PCIe总线继承了PCI总线的所有中断特性（...
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PCIe扫盲——Memory IO 地址空间
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早期的PC中，所有的IO设备（除了存储设备之外的设备）的内部存储或者寄存器都只能通过IO地址空间进行访问。但是这种方式局限性很...
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chipdebug
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PCIe扫盲——基地址寄存器（BAR）详解
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基地址寄存器（BAR）在配置空间（Configuration Space）中的位置如下图所示：
其中Type0 Header最多有6个BAR，而Type1 Header最...
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