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chipdebug
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PCIe扫盲——PCIe配置空间寄存器快速定位表
PCIe
PCI Express的配置空间结构图如下图所示，为了能够快速定位相关寄存器的描述在PCIe Spec中的位置，整理了一个表格，顺便分享到我...
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Ordinary
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Altera USB Blaster,J-Link,ST-Link,CMSIS-DAP多合一下载器开源
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PCIe扫盲——Power Management概述（一）
PCIe
PCIe总线定义的与功耗管理功能（Power Management，PM）相关的主要有：PCI-Compatible PM、Native PCIe Extensions、Bandwith Ma...
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chipdebug
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LTPI协议相关文档分享
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UBM V1.4 协议
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Cordic算法FPGA实现cos,sin (含python和verilog代码)
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PCIe扫盲——TLP Header详解（二）
PCIe
下面用几个具体的例子来讲解TLP Header的格式与作用。因为内容较多，所以分为多篇文章分别进行介绍。第一篇（即本文）介绍IO Req...
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Ordinary
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开源的DDS信号源，带12位AD和10位DA，DDS输出幅度可控
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PCIe扫盲——TLP Header详解（三）
PCIe
Completions
Completions的TLP Header的格式如下图所示：
这里来解释一下Completion Status Codes
· 000b (SC) S...
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PCIe扫盲——TLP Header详解（四）
PCIe
PCIe中的Message主要是为了替代PCI中采用边带信号，这些边带信号的主要功能是中断，错误报告和电源管理等。所有的Message请求采...
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PCIe扫盲——Power Management概述（二）——链路唤醒与PME产生
PCIe
链路唤醒机制可以让处于非D0状态的Endpoint，通过唤醒来请求Root（软件层）让其返回D0状态。PCIe PM的软件层和PCI PM是兼容的，...
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chipdebug
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PCIe扫盲——PCIe卡Spec（CEM）导读
PCIe
前面的文章介绍过，PCIe总线除了有Base Spec，还有关于PCIe卡的Spec（又称为CEM Spec，全称为PCI Express Card Electromechanica...
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chipdebug
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PCIe扫盲——Flow Control基础（一）
PCIe
Flow Control即流量控制，这一概念起源于网络通信中。PCIe总线采用Flow Control的目的是，保证发送端的PCIe设备永远不会发送接收...
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chipdebug
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PCIe扫盲——PCIe总线性能评估（有效数据速率估算）
PCIe
前面的文章提到过PCIe总线（Gen1&Gen2）采用了8b/10b编码，因此其有效数据速率为物理线路上的速率的80%。即Gen1的有效速...
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jenmyliu
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基于 FPGA 及深度学习的人脸检测系统设计
第一部分 设计概述1.1 设计目的新冠病毒的肆虐让整个 2020 年笼罩在恐慌之中，戴口罩成了人们外出必备 的“新日常”。新冠病毒主...
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chipdebug
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PCIe扫盲——Flow Control基础（二）
PCIe
在任何事务层包（TLP）发送之前，PCIe总线必须要先完成Flow Control初始化。当物理层完成链路初始化后，便会将LinkUp信号变为有...
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chipdebug
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查表法实现RS（255，247）码的编码和解码的Verilog源代码
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chipdebug
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PCIe扫盲——基于WinDriver快速开发PCIe驱动简明教程
PCIe
本文将简要介绍如何使用Jungo公司的WinDriver工具快速开发PCI Express设备驱动，以及相关注意事项。本文所使用的的测试平台信息...
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yinhk
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lattice 支持4K的缩放IP scaler_v2.2b
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yinhk
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lattice crosslink MIPI 一分二参考原理图和工程
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分享一个自定义浮点数的fft计算代码
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PCIe扫盲——Quality of Service简介
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前面的文章中介绍过，为了保证视频、音频等数据得到优先传输，PCIe总线实现了一种叫做Quality of Service（QoS）的机制。QoS可以...
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chipdebug
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基于FPGA的数字图像处理Vision1.0.pdf
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PCIe扫盲——DLLP（数据链路层包）详解
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首先说明一下，在本次连载的博文中，DLLP一般指的是由发送端的数据链路层发送，接收端的数据链路层接收的数据包，其和事务层（Tr...
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chipdebug
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ARM核 RTL 开源代码
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FPGA设计高级进阶(清华大学电子工程系).pdf
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计算机原理与设计：Verilog HDL版.pdf
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FPGA设计异步多时钟系统的综合以及描述技巧.pdf
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《FPGA设计技巧与案例开发详解》资料包-V3.2.rar
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