首页
交流分享
积分规则
创作分成
隐私政策
免责声明
电子工程师在线工具
New
发布
开通会员
开通黄金会员
全站资源约8折购买
部分内容免费阅读
VIP用户专属版块
开通黄金会员
开通钻石会员
全站资源约6折购买
部分内容免费阅读
VIP用户专属版块
一对一技术指导
开通钻石会员
开通会员 尊享会员权益
登录
注册
找回密码
首页
交流分享
积分规则
创作分成
隐私政策
免责声明
电子工程师在线工具
New
开通会员 尊享会员权益
登录
注册
找回密码
分享
FPGA CPLD
FPGA常见问题
帖子 613
互动 421
关注 55
FPGA常见问题，如仿真，时序，设计思路等。
2名版主
发布
全部
最新发布
最新回复
热门
精华
Harman
2年前更新
7次阅读
关注
Verilog:模块结构/assign/always[学习笔记day3]
1 模块结构
Verilog的基本设计单元是：模块(block)
Verilog模块的结构由在module与endmodule关键词之间的4个重要部分组成： 端口...
评分
回复
分享
Mr_taotie
2年前更新
7次阅读
关注
FPGA与数字IC求职知识准备 – 数字电路知识总结
前言本文整理了数字电路课程中的相关基本的知识点和较为重要的知识点，用于求职的数电部分的知识准备，差缺补漏。二进制数的算术...
+4
评分
回复
分享
Harman
2年前更新
7次阅读
关注
FPGA：组合逻辑电路的设计
文章目录 组合逻辑电路的设计 组合逻辑电路的设计步骤 组合逻辑电路的设计举例 例1 例2
组合逻辑电路的设计
根据实际逻辑问题，...
+1
评分
回复
分享
senntyou
2年前更新
7次阅读
关注
system verilog 时序逻辑程序中推断组合逻辑？
使用always_ff和在灵敏度列表中指定一个时钟边沿并不意味着过程中的所有逻辑都是时序逻辑。综合编译器将推断出每个被非阻塞赋值...
评分
回复
分享
liximomo
2年前更新
7次阅读
关注
FPGA：数字电路简介
文章目录 数字电路的历史 电子管时代 晶体管时代 半导体集成电路IC 时代 IC的发展阶段 EDA (Electronics Design Automation) 技...
评分
回复
分享
Simeone_xu
3年前更新
7次阅读
关注
FPGA性能问题探讨（一）
最近遇到一个问题，FPGA的性能不够，业务场景是CPU给FPGA发送报文，FPGA处理完成后返回给CPU，在CPU测看到FPGA的性能比较低，然...
+3
评分
回复
分享
Poison
3年前更新
7次阅读
关注
IIC专题原理及应用篇（一）
注：文章是基于IIC的IP核代码
支持三种传输速度：100Kbps，400Kbps，3.5Mbps（需要特殊IO支持）
兼容飞利浦IIC标准
具体代码可以...
评分
回复
分享
Poison
3年前更新
6次阅读
关注
Constraint I/O Delay
About Constraining I/O Delay
为了精确对外部时序进行建模，必须要给出input和output端口的时序信息。因为Vivado仅能给出FPGA内部的时序信息，所以工程师需要用以下命令具体指出FPGA外部的时序延迟信息。
• set_input_delay
• set_output_delay
评分
回复
分享
Poison
3年前更新
6次阅读
关注
High Speed Serdes 技术概述（三）
1.3.4 差动驱动器
差分驱动级是一个模拟电路，用于驱动差分信号的真信号和补信号。输出数据的驱动必须使抖动最小化。在一些...
+5
评分
回复
分享
comehope
3年前更新
6次阅读
关注
设计一个 RISC-V CPU，第 1 部分：软件工程师如何学习FPGA和硬件设计描述语言
作者 | Hannah McLaughlin译者 | Sambodhi策划 | 凌敏本文最初发表于作者个人网站，经原作者 Hannah McLaughlin 授权，InfoQ 中...
评分
回复
分享
Zack
2年前更新
6次阅读
关注
FPGA之按键控制LED
一、按键开关
1、按键开关（轻触开关）：主要是指轻触式按键开关，属于电子元器件类，使用时以满足操作力的条件向开关操作方向施...
评分
回复
分享
Poison
3年前更新
6次阅读
关注
PCIe架构概述（四）
PCIe专题非报告事务普通读：图2-18显示了一个从端点发送到系统内存的内存读取请求的示例。有关TLP内容的详细讨论，请参阅第5章，...
+6
评分
回复
分享
luozz
2年前更新
6次阅读
关注
FPGA自动仿真的tcl脚本分享
quit -sim
.main clear
vlib work
vlog ./tb_fsm.v //仿真文件名
评分
回复
分享
jenmyliu
3年前更新
6次阅读
关注
FPGA开发流程每一环节的物理含义和实现目标
FPGA的开发流程是遵循着ASIC的开发流程发展的，发展到目前为止，FPGA的开发流程总体按照图1进行，有些步骤可能由于其在当...
+15
评分
回复
分享
alienzhou
3年前更新
6次阅读
关注
FPGA结构(1)
FPGA
结构
设计能够成功的关键是要对FPGA结构、功能、可用资源和局限性有一个很好的了解。本则将以Xilinx Virtex-6系列为例，简...
评分
回复
分享
jenmyliu
3年前更新
6次阅读
关注
FPGA静态时序分析—IO口时序
1.1 概述 在高速系统中FPGA时序约束不止包括内部时钟约束，还应包括完整的IO时序约束和时序例外约束才能实现PCB板级的时序收敛...
+5
评分
回复
分享
mscststs
3年前更新
6次阅读
关注
FPGA基础知识，入门必看！
FPGA全称是Field-Programmable Gate Array，即现场可编程门阵列。
1、跟单片机相比
结构不同： 1.1、单片机的引脚、资源以...
+2
评分
回复
分享
jenmyliu
3年前更新
6次阅读
关注
FPGA入门-查找表结构和乘积项结构
查找表（Look-Up-Table)简称为LUT，LUT本质上就是一个RAM。目前FPGA中多使用4输入的LUT，所以每一个LUT可以看成一个有4位地址线...
+3
评分
回复
分享
yinhk
3年前发布
5次阅读
关注
FPGA开发 TCL 常用命令
pwd获取当前目录cd进入目录glob 返回模式匹配的文件名， 经常用来列目录。用法示例
评分
回复
分享
comehope
3年前更新
5次阅读
关注
FPGA 基本模块的主要功能
1．可编程输入/输出单元（I/O 单元）
FPGA 的 I/O 单元被划分为若干个组（Bank），每个 Bank 的接口标准由其接口电压 VCCO 决定...
评分
回复
分享
ipqsn
3年前更新
5次阅读
关注
数字ic基础-FPGA中的memory and block ram
am：random access memory
FPGA中存储数据的几种方式
1.DFF 也就是D触发器，但只保存1bit，数据大了浪费资源
2.利用look up tab...
+2
评分
回复
分享
littleLyon
3年前更新
5次阅读
关注
滤波器的功能和分类
滤波器是一种选频装置，可以使信号中特定的频率成分通过，而极大地衰减其它频率成分。在测试装置中，利用滤波器的这种选频作用，可以滤除干扰噪声或进行频谱分析。
广义地讲，任何一种信息传输的通道（媒质）都可视为是一种滤波器。因为，任何装置的响应特性...
评分
回复
分享
Poison
3年前更新
5次阅读
关注
FPGA复位信号设计讨论
复位概述复位作为电子系统中最常见的信号同时也是最重要的信号，它对工程师整体的设计表现有着极大的影响。复位信号可能深刻影响...
评分
回复
分享
Sahara
3年前更新
5次阅读
关注
FPGA学习— Verilog快速入门
Verilog HDL（Hardware Description Language）是在用途最广泛的C语言的基础上发展起来的一种硬件描述语言，具有灵活性高、易学...
+21
评分
回复
分享
Incess
3年前更新
4次阅读
关注
FPGA时钟系统的移植
ASIC 和FPGA芯片的内核之间最大的不同莫过于时钟结构。ASIC设计需要采用诸如时钟树综合、时钟延迟匹配等方式对整个时钟结构进行...
评分
回复
分享
Jackle910
3年前更新
4次阅读
关注
FPGA学习-FIFO使用小结
FIFO的使用非常广泛，一般用于不同时钟域之间的数据传输，或者用于不同数据宽度之间的数据匹配。在实际的工程应用，可以根据需要...
+2
评分
回复
分享
wanakaka
3年前发布
4次阅读
关注
FPGA学习-FPGA中逻辑复制
在FPGA设计中经常使用到逻辑复制，逻辑复制也用在很多场合。1． 信号驱动级数非常大，扇出很大，需要增加驱动力 逻辑复制...
评分
回复
分享
Lanneret36
2年前发布
4次阅读
关注
ISE开发FPGA时以原理图为顶层设计，突然间打不开顶层文件
ISE开发FPGA时以原理图为顶层设计，突然间打不开顶层文件，不知怎么回事？
评分
回复
分享
Firmware
11个月前发布
4次阅读
关注
XCELIUMMAIN23.03.002（含patch）
该帖子内容已隐藏
付费阅读
3
积分
黄金会员
2
钻石会员
1
登录购买
此内容为付费阅读，请付费后查看
评分
回复
分享
weakish
2年前更新
4次阅读
关注
FPGA：逻辑代数的基本公式和规则
文章目录 逻辑代数的基本公式 基本公式 常用公式 示例 逻辑代数的基本规则 代入规则 反演规则 对偶规则
逻辑代数的基本公式
基本...
评分
回复
分享
上一页
1
…
18
19
20
21
下一页
跳转
55人已关注
分享
FPGA常见问题
FPGA常见问题，如仿真，时序，设计思路等。
发布
关注
帖子
613
互动
421
阅读
5.6W+
搜索
开启精彩搜索
最新的帖子
在手机上浏览此页面
登录
没有账号？立即注册
邮箱
验证码
发送验证码
记住登录
账号密码登录
登录
用户名/手机号/邮箱
登录密码
记住登录
找回密码
|
免密登录
登录
注册
已有账号，立即登录
设置用户名
手机号或邮箱
验证码
发送验证码
设置密码
重复密码
注册
注册即表示同意
用户协议
、
隐私声明
欢迎光临！
ChipDebug入站需知
本站无广告也无付费项目，如发现帐号发垃圾帖或评论的一律封号！
ChipDebug是一个芯片开发调试分享网站
欢迎您的到来！如果您没有帐户请先点击下方按钮进行
注册
登录
注册
找回密码
积分规则
![Verilog:模块结构/assign/always[学习笔记day3]-ChipDebug](http://chipdebug.com/wp-content/uploads/2023/01/91673777405.png)
![Verilog:模块结构/assign/always[学习笔记day3]-ChipDebug](http://chipdebug.com/wp-content/uploads/2023/01/71673777408.png)
