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FPGA CPLD
FPGA常见问题
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FPGA常见问题，如仿真，时序，设计思路等。
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ipqsn
2年前更新
16次阅读
关注
Modelsim的仿真之路（Memory小技能）
续上
许久没更新了，间歇性来写写，还是继续Modelsim中关于内存的操作，涉及的文件可在文末自行获取，本篇对应memory的文件夹。
...
+30
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Poison
3年前更新
15次阅读
关注
AXI4/AXI5-Stream协议介绍
AXI4-Stream简介
AXI4-Stream概念简介
AXI4-Stream是一种标准协议接口，可用于芯片内部的数据流传输，不同于内存数据传输相关协...
+5
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Poison
3年前更新
15次阅读
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详析电流隔离 LVDS 接口
信号传输应用常用的方法是低压差分信号传输(LVDS)。这涉及到串行数据传输的既有接口标准 (TIA/EIA-644)，除了极佳的节能特性和高...
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liximomo
3年前更新
15次阅读
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fpga实操训练（vga测试）
【 声明：版权所有，欢迎转载，请勿用于商业用途。 联系信箱：feixiaoxing @163.com】我自己读书那会，买的电脑还是以台式机居...
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Poison
3年前更新
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PCIe配置概述（一）
关于前一章
前一章节对 PCIe 体系结构进行了全面介绍，我们将其看作是一种“执行层 （executive level）”概述。它对协议中描述 ...
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kikong
2年前更新
15次阅读
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基于Xlinx的时序分析与约束（4）—-主时钟约束
主时钟约束语法
主时钟约束，就是我们对主时钟（Primary Clock）的时钟周期进行约束（告诉综合工具布局布线的标准），这个约束是...
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pipisan
2年前更新
14次阅读
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【LabVIEW FPGA图形化】IP集成节点：频率计
一、前情提要
上一节内容介绍了LabVIEW中比较实用的ngc文件，并通过分析底层代码的编写进一步说明了LabVIEW中IP集成节点导入与编...
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wuzhihua2
2年前更新
14次阅读
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FPGA状态机中的独热编码（One-hot）Fsm onehot
独热编码即 One-Hot 编码，又称一位有效编码，其方法是使用N位状态寄存器来对N个状态进行编码，每个状态都有它独立的寄存器位，...
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Harman
2年前更新
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VHDL实现动态数码管驱动
目录
简介:
程序设计：
下载验证：
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Poison
3年前更新
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RTL设计风格及Verilog编码规范（一）
一、同步设计
1.1 时钟的同步设计
关注问题：
（1）设计中尽可能使用单时钟和单时钟边沿触发
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vishva
3年前更新
14次阅读
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PCIe架构概述（三）
PCIe专题 设备层简介PCIe定义了分层的架构，如图2-12所示。可以将这些层在逻辑上拆分为两个独立运行的部分，因为它们各自具有用...
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BertramChen
3年前更新
14次阅读
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FPGA学习-8B/10B编码
8B/10B，也叫做8字节/10字节或8B10B。8B/10B方式最初由IBM公司于1983年发明并应用于ESCON(200M互连系统），由Al Widmer和Peter F...
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Poison
3年前更新
14次阅读
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IIC专题代码篇（一）
一、IIC主机bit控制// Timing: Normal mode Fast mode
/////////////////////////////////////////////////////////////////////...
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popomao
3年前发布
14次阅读
关注
FPGA数字图像处理的应用场景
数字图像处理方法的重要性源于两个主要应用领域：Ÿ o 改善图像信息以便解释。o 为存储、传输和表示而对图像数据进行处理，以便于机器自动理解。图像处理(image processing)：用计算机对图像进行分析，以达到所需结果的技术。又称影像处理。一般指数...
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fifo
2年前发布
14次阅读
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DAC产生刺激信号，求大佬解答
用SPI配置寄存器输出刺激信号，寄存器配置的数据没有问题，ila抓到的时序和返回的数据也都是对的，硬件也没有问题，还有什么地方会有问题啊，想了好几天了，还是没解决？
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Poison
3年前更新
14次阅读
关注
IIC专题代码篇（二）
三、顶层模块// synopsys translate_off
`include "timescale.v"
// synopsys translate_on
`include "i2c_master_defines.v"
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BertramChen
3年前更新
13次阅读
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Verilog阻塞与非阻塞赋值详解
导言
关于Verilog阻塞与非阻塞的问题，非常多的教程给出了解释，但大多仅给出一些关于阻塞非阻塞的设计原则，没有更加详细的讲解...
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XYShaoKang
2年前更新
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二进制转BCD码模块
01概述BCD码（Binary-Coded Decimal），用4位二进制数来表示1位十进制数中的0~9这10个数码，是一种二进制的数字编码形式，用二...
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chipdebug
3年前更新
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PCIe扫盲——物理层逻辑部分基础（二）
PCIe
上一篇文章中提到了Mux会对来自数据链路层的数据（TLP&DLLP）插入一些控制字符，如下图所示。当然，这些控制字符只用于物理...
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BertramChen
3年前更新
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FPGA/IC优质开源项目（九）RISC
导言
本期主要给大家带来优秀的risc的处理器，前面推荐过几个比如阿里的开源cpu以及zipcpu，大家可以到开源集合中查看，本次推荐...
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weakish
3年前更新
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Linux下FPGA开发工具ISE的环境变量设置
Xilinx ISE 工具版本Xilinx ISE软件有两个版本:数字格式和字母格式。数字版本是用于客户的软件版本。它的格式是<主版本号&g...
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Incess
3年前更新
13次阅读
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ASIC向FPGA的移植
ASIC原型验证是整个验证环节中非常重要的步骤之一，也是将ASIC的代码移植到FPGA平台上最重要的原因，本文章的意义在于：
对于系...
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eurkidu
3年前更新
13次阅读
关注
FPGA流控的一种方式——计算在途数量
最近在项目中遇到一个反压的问题，简化下模型如下图所示。A模块给其他逻辑发送数据，其他逻辑会返回一定量的数据给B模块,且B模块...
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Poison
3年前更新
13次阅读
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什么是JESD204标准，为什么我们要重它？
一种新的转换器接口的使用率正在稳步上升，并且有望成为未来转换器的协议标准。这种新接口JESD204诞生于几年前，其作为转换...
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BertramChen
3年前更新
13次阅读
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FPGA学习经验总结
在学习一门技术之前我们往往从它的编程语言入手，比如学习单片机时，我们往往从汇编或者C语言入门。所以不少开始接触FPGA的开发人员，往往是从VHDL或者Verilog开始入手学习的。但我个人认为，若能先结合《数字电路基础》系统学习各种74系列逻辑电路，深刻理解...
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boxFPGA
2年前更新
13次阅读
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SystemVerilog-时序逻辑建模（4）同步和异步复位
Part1数字硬件建模SystemVerilog-时序逻辑建模（4）同步和异步复位数字门级电路可分为两大类：组合逻辑和时序逻辑。锁存器是组合...
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Poison
3年前更新
13次阅读
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WaveDrom波形软件
一、WaveDrom介绍
这个软件很简单，是以代码的形式来描述波形，有在线版本和软件版本，这里面都有一个简单的介绍文档，几乎不需...
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Poison
3年前更新
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RTL设计风格及Verilog编码规范（二）异步时钟处理
一、时钟
1.1 为时钟生成电路建立单独模块
1、对于时钟生成电路，建议使用一个单独的模块管理（复位同样建议这样做）
2、不要对...
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chipdebug
3年前发布
12次阅读
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FPGA 产生伪随机数(LFSR)的verilog代码
挺简单的一段代码，来自Altera（现在的Intel PSG）,不过这个离散程度无法确认。// Copyright 2007 Altera Corporation. All rights reserved.
// Altera products are protected under numerous U.S. and foreign patents,
// maskwork rights, copyrights an...
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mscststs
3年前更新
12次阅读
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FPGA基础知识，入门必看！
FPGA全称是Field-Programmable Gate Array，即现场可编程门阵列。
1、跟单片机相比
结构不同： 1.1、单片机的引脚、资源以...
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