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赛灵思是FPGA、可编程SoC及ACAP的发明者, 其高度灵活的可编程芯片由一系列先进的软件和工具提供支持,可推动跨行业和多种技术的快速创新- 从消费电子类到汽车类再到云端。
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VLTEX-E数据表-某些LVDS引脚(IOAL LVDSYDLL用于全局时钟)看起来是差分对的N侧和P侧
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7年前发布
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**过时的*3.3i芯片-在Windows 98 SE使用USB端口和多线程电缆时“无法打开通信端口”错误
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3.1I核心生成器-8B/10B解码器2 -当使用无效输入代码时,“CODEYER”标志不出现
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模型(MXE,SE,PE)-“错误:(341):未知实体:。使用扩展
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5.2i CPLD TSim -在反向注释(定时)仿真中某些总线的位阶颠倒
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4.1I HDL Bunter -我能用HDL BeNeCH在一个有多个时钟的设计上吗?
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61I时序分析仪,VIETEX II -温度和电压分配可用
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LogICore 1-D离散余弦变换(DCT)V1.0—1D DCT的生成可能导致Solaris机器(DYIP4)的堆芯转储
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7.1i时序分析器-当我打开一个新报告的PCF和NCD文件时,会出现一个错误:“预期一个路径名参数”
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3.1i,ViTEX-E速度文件-VelTeX-E速度文件更新在Service PACK 8中
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3×FPGAExpress- FPGAExpress不正确综合比较器
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3.1i核心生成器-通过ISE打开XCO文件在双端口块存储器上改变宽度
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4.2i基础-项目管理器:当我升级到一个新的基础版本并重新实现一个项目时,选择一个不正确的部分
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VLTEXI/PRO-什么是正确的LVPECL终止方案?
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3.1i内核生成器-分布式内存V3参数文件(.xCo)与分布式内存V4xx不兼容。
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4.1IVITEX-E PAR砂土产生不可路由连接
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4.1i核心生成器-错误:“XCO文件正在被另一个应用程序使用”
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3.1i基础在Windows 2000上启动项目导航器需要更长的时间,如果用户不是管理员的话。
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4.1IIS-“编辑UCF文件”过程不打开UCF文件进行编辑,或者打开不正确的编辑器。
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4.1i核心生成器-“错误:无法创建.Sym符号文件”和“错误:为核心[CORNAME]的细化失败
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12.1 NGDBug /约束-“错误:NGD:635 -规范”偏移=在“ON信号”(FordIn)“无效”之前的PS中…
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5.1i安装CD -我可以安装ISE 5.1i在Windows NT,即使它不支持?
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*过时的*3.1IS8JTAGProgrammer- 18V00 -“错误:JTAG……太多的错配…验证中止。”
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3.1i核心生成器-在3.1I/3.2i IP更新4(DYIP4)中已知的问题。
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HDL BeNCHER——我如何从具有未初始化输入的波形获得有效输出的仿真?
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ViTEX-E -在哪里可以得到ViTEX-E的PIN函数图?
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3.1i Solaris/HP CAE库安装-安装代码引用不存在的IDATA目录。
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LogICORSPI4.2(POSS-PHY L4)V3.X-Verilog仿真不起作用:RDAT总线上的数据在FIFO FIFO中出现无序。
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VyTEX/-E/-II/-II Pro/- 4/- 5/6 -温度传感二极管测量(DXP,DXN)的使用
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3.1i XST-XST在BufGMUX之后插入BUF。
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