SOC FPGA论坛首页-ChipDebug

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20小时前发布14次阅读

安路FPGA使用JTAG下载比特流固件出错

基于PotatoPie V4.3开发板，设计了一个板子，然后使用FPGA下载器给FPGA下载比特流文档，出现错误，如下：图1我的板子JTAG仿真...

安路FPGA使用JTAG下载比特流固件出错-ChipDebug

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DR1器件FD裸机驱动例程

如下图：在右侧就可以看到例程文件和代码。

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测试终端是否支持256色的脚本以及强制终端为256色

for i in {0..255}; do printf "\033[48;5;${i}m %03d " $i if (( ($i + 1) % 16 == 0 )); then printf "\033[0m\n" fi
done执行以下命令可以强制终端为256色：export TERM=xterm-256colo

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2天前更新4次阅读

DR1器件仿真报GSR.done_gwe错误解决办法

错误如下：解决办法如下：

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3天前发布4次阅读

视频编解码基础概念

本文涉及视频编解码最基础概念，从工程应用角度出发，帮助理解和编写源码。本文并不涉及深层次原理和算法。本文为作者原创，转载...

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6天前发布3次阅读

FFmpeg编解码处理2-编解码API详解

本文为作者原创，转载请注明出处：https://www.cnblogs.com/leisure_chn/p/10584925.htmlFFmpeg编解码处理系列笔记：[0]. FFmpeg时间戳详解[1]. FFmpeg编解码处理1-转码全流程简介[2]. FFmpeg编解码处理2-编解码API详解[3]. FFmpeg编解码处理3-视频编码[4]. F...

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5天前更新7次阅读

FFmpeg编解码处理3-视频编码

本文为作者原创，转载请注明出处：https://www.cnblogs.com/leisure_chn/p/10584937.htmlFFmpeg编解码处理系列笔记：[0]. FFmpeg...

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6天前发布2次阅读

FFmpeg编解码处理4-音频编码

本文为作者原创，转载请注明出处：https://www.cnblogs.com/leisure_chn/p/10584948.htmlFFmpeg 编解码处理系列笔记：[0]. FFmpeg时间戳详解[1]. FFmpeg编解码处理1-转码全流程简介[2]. FFmpeg编解码处理2-编解码API详解[3]. FFmpeg编解码处理3-视频编码[4]. ...

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3天前更新17次阅读

FFmpeg编解码处理1-转码全流程简介

本文为作者原创，转载请注明出处：https://www.cnblogs.com/leisure_chn/p/10584901.htmlFFmpeg编解码处理系列笔记：[0]. FFmpeg...

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8天前更新6次阅读

SVF 规范详解

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6天前更新19次阅读

Qt实现TFTP Server和 TFTP Client

转自https://blog.csdn.net/flysnow010/article/details/1369349501 TFTP协议TFTP协议是基于UDP的简单文件传输协议，协议双方为C...

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11天前发布0次阅读

提问关于Altera Cyclone V系列的 5CEBA4U15 AES加密文件无法生成的问题

如题，按照官方AN556手册是支持该系列进行AES加密的。实际按手册操作后，在生成.ekp文件那步在器件选择时选择EPCQ64后，ASx4模式下，选择SOF属性后只有压缩，并无加密文件生成弹窗，求解

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祥哥爱学习

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14天前发布7次阅读

已解决请教易灵思原语问题，哪里可以看到易灵思支持的原语

请问下，易灵思有没有类似赛灵思bufr的原语

易灵思(Elitestek)

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15天前发布2次阅读

orcad所有同名信号网络高亮的方法

下面这个方法我个人更喜欢一点，可以真的实现全部高亮它会自动搜索同名网络高亮，并在界面中显示查找到的信息

orcad所有同名信号网络高亮的方法-ChipDebug

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21天前发布26次阅读

DFB激光器的稳频系统。用FPGA做

我目前要做的是DFB激光器的稳频。目前差一个数字电路的稳频系统，我打算用FPGA来实现。要求：一个ADC（内置或者外接的模块）八通道以上，来采集8路电压信号，通过主控处理，再由2路输出的DAC来控制激光器，，相当于一个反馈系统，用到的算法可能有PID之类的（...

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21天前发布5次阅读

提问vivado仿真

ERROR: [VRFC 10-2063] Module <uart_rx> not found while processing module instance <u_uart_rx> [E:/fpga program/uart/uart.srcs/sources_1/new/uart.v:144]请问这个问题该怎么解决

FPGA常见问题

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24天前更新6次阅读

提问接口转换将sramif模块中的bankA和bankB转换为AXI-Stream接口，应当如何解决这个问题？（求助大佬）

module sramif #(
parameter integer NUM_CPUS = 1,
parameter integer AXI_SRAM_ID = 12
)(

FPGA常见问题

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24天前发布13次阅读

adc模块需求

采样率mhz级别，就是同时要多通道（至少4通道），用于axu9egb（Zynq UltraScale+ MPSoC）上实现对模拟信号的高速采集。请问哪种型号的adc模块能够满足

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XL_易灵思FPGA

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25天前发布16次阅读

精programmer烧写用户数据到flash-v1

今天有客户提出怎样把用户数据写入到flash的操作，本来以为写的programmer都不支持了，但是经过多次验证发现还是可以的，可能之...

programmer烧写用户数据到flash-v1-ChipDebug

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易灵思(Elitestek)

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26天前发布17次阅读

把fpga模拟成其它硬件的学习路径？

需要学习多少小时可以出师？

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31天前更新20次阅读

已解决刚下载的软件小白打开工程文件报错，这哪出问题了

刚下载的软件小白打开工程文件报错，这哪出问题了-ChipDebug

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38天前发布13次阅读

提问小白求助-关于FMC接口引脚的设置

如果将一个FMC接口与FPGA连接，但PCB上FMC接口的PRSNT_M2C_L引脚设置为了悬空，并未连接到地，请问这样影响FMC接口的正常使用吗

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38天前发布9次阅读

提问想请问下有没有不使用ip核编写rom的资料？

ip核被ban了用不了，找了好久没有不用ip核编写rom的资料，想来求助下各位佬有没有相关资料。

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40天前更新11次阅读

武汉高级FPGA招聘

公司目前在研发一个高端测试类项目产品，急需高级或资深级FPGA工程师，尤其是有高速DDR5相关经验的。岗位职责：1、参与产品技术评审及需求分析，进行逻辑系统/模块设计、仿真；2、配合硬件工程师进行器件选型，并基于器件进行代码编写、调试和验证；3、配合软...

FPGA招聘信息

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42天前发布7次阅读

GAL系列产品编程器

Lattice公司的GAL系列产品芯片的编程器是什么型号？

Lattice-莱迪斯

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44天前发布8次阅读

已解决实例33图像叠加例化后报错

实例33图像叠加例化后报错，工程中找不到emb32，但是将图2图像叠加功能输出部分注释后报错消失，请问这是什么原因报错，怎么解决...

实例33图像叠加例化后报错-ChipDebug

实例33图像叠加例化后报错-ChipDebug

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等级-LV2-ChipDebug

45天前更新21次阅读

已解决td_riscv_potatoPieV4 中RISC-V 是否有类似ZYNQ中EMIO，用于PS（RISC-V中）控制（FPGA）PL引脚的功能

RISC-V教程里面有控制GPIO和UART,是否可以可以PL的任意GPIO，类似ZYNQ的接口EMIO?另外我的TD里面定义后UART的rx,tx引脚后，使用RISC-V是否可以通讯？

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46天前发布24次阅读

已解决安装好FD软件后，菜单栏没有AnlogicTools –> Create Mif

安装好FD软件后，菜单栏没有AnlogicTools –> Create Mif-ChipDebug

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46天前发布10次阅读

已解决正常工程编译综合布线成功后加入自动Debugger重新编译，综合处出现惊叹号是什么原因？

工程编译综合布线成功后,使用自动Debugger进行在线调试,重新编译综合布线成功后，出线如下图所示的的惊叹号，过程中并未报错只是...

正常工程编译综合布线成功后加入自动Debugger重新编译，综合处出现惊叹号是什么原因？-ChipDebug

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51天前发布95次阅读

已解决关于MCU模拟JTAG下载aje格式文件失败问题

PCIe 一、AJE2JTAG文档CLK时序描述1、1.6.2.2 延时校准章节描述该章节描述TCK进行校验，开启RUNTEST_CALIBRATION后，是为了验证Anl...

关于MCU模拟JTAG下载aje格式文件失败问题-ChipDebug

关于MCU模拟JTAG下载aje格式文件失败问题-ChipDebug

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