SOC FPGA论坛首页-ChipDebug-第316页

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等级-LV3-ChipDebug

2年前更新197次阅读

Win7安装安路AL-Link下载器驱动提示“无法验驱动程序数字签名”代码52怎么办？

有些Win7系统在安装18年后的驱动时，设备管理器显示黄色感叹号，并提示“无法验证此设备所需的驱动程序的数字签名，代码52”，是...

Win7安装安路AL-Link下载器驱动提示“无法验驱动程序数字签名”代码52怎么办？-ChipDebug

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等级-LV3-ChipDebug

3年前更新676次阅读

vivado软件无法连接下载器或下载失败解决方案

1、Xilinx HS3 高速下载器可以通过如下链接购买https://item.taobao.com/item.htm?spm=a21n57.1.0.0.7f83523c7ugRiu&id=7069...

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等级-LV2-ChipDebug

3年前更新679次阅读

精通过MCU/MPU/CPU嵌入式下载升级Anlogic EF2/3的调试经验分享

感谢安路技术交流群里的FPGA小99的分享，挣点积分换资源咯。目录EF2/3 嵌入式升级FAQEF2/3 - 15/25/45支持的升级接口从串模式JTA...

通过MCU/MPU/CPU嵌入式下载升级Anlogic EF2/3的调试经验分享-ChipDebug

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等级-LV3-ChipDebug

3年前更新17次阅读

TD5.6.3 chipwatch(CWC) 逻辑端源代码

含两个版本， verilog 和 sv版。

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等级-LV3-ChipDebug

3年前更新157次阅读

ICMaker 的 LATTICE HW-USBN-2B 下载器驱动安装教程

首先安装网盘里面的programmer软件，百度网盘中软件在这里
我们自有网盘中的软件在这里。
安装完成之后在软件的安路目录下找到如...

ICMaker 的 LATTICE HW-USBN-2B 下载器驱动安装教程-ChipDebug

ICMaker 的 LATTICE HW-USBN-2B 下载器驱动安装教程-ChipDebug

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Lattice-莱迪斯

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等级-LV3-ChipDebug

2年前更新896次阅读

PotatoPie 2.1/3.0 教程(1) TD工程的创建，编译，下载

新建工程添加源码1.双击图标打开软件2. 输入工程名，存储路径，并选择器件3. 新建源码记得文件类型选择verilog, 其它文件类型暂...

PotatoPie 2.1/3.0 教程(1) TD工程的创建，编译，下载-ChipDebug

PotatoPie 2.1/3.0 教程(1) TD工程的创建，编译，下载-ChipDebug

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等级-LV3-ChipDebug

2年前更新2520次阅读

PotatoPie 2.1/3.0 教程目录

目录更新时间2024/01/12,将持续更新PotatoPie 2.1/3.0 教程(0) TD软件的安装和AL-Link mini 下载器的驱动安装PotatoPie 2.1/3.0 教程(1) TD工程的创建，编译，下载PotatoPie 2.1/3.0 教程(2) —— 实验1 FPGA实现LED流水灯和呼吸灯PotatoPie 2.1/3.0 教程(3) ...

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等级-LV1-ChipDebug

3年前更新692次阅读

vivado报错-debug hub core时钟检测不到

问题描述
在使用JTAG仿真器在vivado环境下抓信号时，报如下错误:
Warning: The debug hub core was not detected
Resolution： 1、Make sure the clock connected to the debug hub(dbg hub) core is free running clock and is active 2、Make sure the B...

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等级-LV3-ChipDebug

3年前发布37次阅读

齐纳二极管保护 FPGA 5V 输入

尽管 5V 供电逻辑在许多应用中仍然很常见，但大多数 FPGA 支持 3.3V 及更低的接口电平。当您将 FPGA 连接到更高的电压电平时，FP...

齐纳二极管保护 FPGA 5V 输入-ChipDebug

齐纳二极管保护 FPGA 5V 输入-ChipDebug

齐纳二极管保护 FPGA 5V 输入-ChipDebug

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等级-LV4-ChipDebug

3年前发布67次阅读

使用 Simulink 进行 FPGA 设计和验证

Xilinx System Generator for DSP 是一个 MATLAB Simulink 模块集，可促进系统设计。System Generator for DSP 以熟悉的 M...

使用 Simulink 进行 FPGA 设计和验证-ChipDebug

使用 Simulink 进行 FPGA 设计和验证-ChipDebug

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等级-LV3-ChipDebug

3年前发布103次阅读

基于安路PCIe SGDMA 高速数据传输方案

安路科技PH1A系列FPGA定位高性价比逻辑器件，针对高带宽应用场景，能够在保持低功耗的前提下，提供同类最佳的收发器和信号处理功...

基于安路PCIe SGDMA 高速数据传输方案-ChipDebug

基于安路PCIe SGDMA 高速数据传输方案-ChipDebug

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等级-LV3-ChipDebug

3年前发布70次阅读

安路科技发布SALDRAGON®飞龙系列全新FPSoC®器件，多元化产品矩阵加速布局下游市场

11月11日，先进可编程逻辑技术探索者上海安路信息科技股份有限公司（代码：688107.SH,以下简称“安路科技”）在广州宣布推出全新...

安路科技发布SALDRAGON®飞龙系列全新FPSoC®器件，多元化产品矩阵加速布局下游市场-ChipDebug

安路科技发布SALDRAGON®飞龙系列全新FPSoC®器件，多元化产品矩阵加速布局下游市场-ChipDebug

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等级-LV1-ChipDebug

3年前更新24次阅读

莱迪思动态前瞻：开发者大会即将到来

备受期待的莱迪思开发者大会即将到来，莱迪思也刚刚公布了大会的全部议程。在12月5日至7日的三天时间内将举办一系列精彩的主题演...

莱迪思动态前瞻：开发者大会即将到来-ChipDebug

莱迪思动态前瞻：开发者大会即将到来-ChipDebug

莱迪思动态前瞻：开发者大会即将到来-ChipDebug

莱迪思动态前瞻：开发者大会即将到来-ChipDebug

Lattice-莱迪斯

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等级-LV3-ChipDebug

3年前更新1508次阅读

安路TangDynasty(TD)中BRAM 模块IP使用

AL3 系列器件支持嵌入式存储器模块（Embedded Memory Block）。 AL3-10 中包括两类 EMB： EMB9K 和 EMB32K。EMB9K 每块容量 9Kbi...

安路TangDynasty(TD)中BRAM 模块IP使用-ChipDebug

安路TangDynasty(TD)中BRAM 模块IP使用-ChipDebug

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等级-LV3-ChipDebug

3年前发布22次阅读

EF2M程序烧写完MCU不生效的处理办法

EF2M芯片在完成FLASH下载后MCU程序不生效的情况下，需要拉低一下PROGRAMN即可启动生效。猜测原因与其底层机制有关。

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等级-LV2-ChipDebug

3年前更新124次阅读

技术白皮书 | EasyCDR®——满足您特定需求的定制化解决方案

1. SerDes介绍
SerDes由串行器（Serializer）和解串器（Deserializer）两个英文单词组合而成。SerDes可以通过同轴电缆或双绞线传...

技术白皮书 | EasyCDR®——满足您特定需求的定制化解决方案-ChipDebug

技术白皮书 | EasyCDR®——满足您特定需求的定制化解决方案-ChipDebug

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等级-LV2-ChipDebug

3年前更新36次阅读

如何做到一套FPGA工程无缝兼容两款不同的板卡？

试想这样一种场景，有两款不同的FPGA板卡，它们的功能代码90%都是一样的，但是两个板卡的管脚分配完全不同，一般情况下，我们需...

如何做到一套FPGA工程无缝兼容两款不同的板卡？-ChipDebug

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等级-LV2-ChipDebug

3年前更新62次阅读

Xilinx FPGA芯片内部时钟和复位信号使用

如果FPGA没有外部时钟源输入，可以通过调用STARTUP原语，来使用FPGA芯片内部的时钟和复位信号，Spartan-6系列内部时钟源是50MHz...

Xilinx FPGA芯片内部时钟和复位信号使用-ChipDebug

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等级-LV2-ChipDebug

3年前更新542次阅读

Xilinx FPGA Multiboot设计与实现（Spartan-6和Kintex-7示例）

都有哪些内容？
FPGA固件升级方案
Golden镜像和Multiboot镜像简介
ISE环境下实现（XC6SLX9）

Xilinx FPGA Multiboot设计与实现（Spartan-6和Kintex-7示例）-ChipDebug

Xilinx FPGA Multiboot设计与实现（Spartan-6和Kintex-7示例）-ChipDebug

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等级-LV2-ChipDebug

3年前更新101次阅读

获取Xilinx FPGA芯片IDCODE的4种方法（支持任何FPGA型号）

Xilinx任何一款FPGA型号都有一个唯一的IDCODE，用来区分不同的产品，同一型号不同封装的FPGA IDCODE是一致的，可以通过JTAG、ICA...

获取Xilinx FPGA芯片IDCODE的4种方法（支持任何FPGA型号）-ChipDebug

获取Xilinx FPGA芯片IDCODE的4种方法（支持任何FPGA型号）-ChipDebug

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等级-LV1-ChipDebug

3年前更新174次阅读

万字长文带你搞懂JTAG的门门道道

前言
JTGA这个东西IC和嵌入式靓仔们肯定是有用过的，但是对于JTAG内部的东西，以及实现如果不了解的，可以看看这篇文章。
之前和...

万字长文带你搞懂JTAG的门门道道-ChipDebug

万字长文带你搞懂JTAG的门门道道-ChipDebug

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FPGA常见问题

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等级-LV1-ChipDebug

3年前更新73次阅读

技术货：傅立叶分析和小波分析之间的关系？（通俗讲解）

从傅里叶变换到小波变换，并不是一个完全抽象的东西，完全可以讲得很形象。小波变换有着明确的物理意义，如果我们从它的提出时所...

技术货：傅立叶分析和小波分析之间的关系？（通俗讲解）-ChipDebug

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等级-LV4-ChipDebug

3年前更新106次阅读

一个硬件工程师说：RF 数据转换器软件驱动真的很简单！

转自Xilinx 官微
在我的职业生涯中，我一直从事模拟和混合信号系统、FPGA 架构、I/O 和信号完整性方面的工作。所以我真的...

一个硬件工程师说：RF 数据转换器软件驱动真的很简单！-ChipDebug

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等级-LV2-ChipDebug

3年前更新206次阅读

精set_input_delay如何约束？

首先还是需要明确一点，这个约束没有延迟的作用，如果需要对输入信号做延迟，就要使用IODELAY这种原语。
什么是input_delay？
...

set_input_delay如何约束？-ChipDebug

set_input_delay如何约束？-ChipDebug

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FPGA常见问题

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等级-LV1-ChipDebug

3年前更新81次阅读

光刻机行业报告2023

转自网络，报告来源：中泰电子团队

光刻机行业报告2023-ChipDebug

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FPGA新闻资讯

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等级-LV1-ChipDebug

3年前更新143次阅读

【FPGA图像处理实战】- RGB与HSV互转

HSV颜色空间也是图像处理中常用一个颜色空间，主要应用于调色处理。本文将介绍一下RGB与HSV互转，其中复杂度比“RGB与YUV互...

【FPGA图像处理实战】- RGB与HSV互转-ChipDebug

【FPGA图像处理实战】- RGB与HSV互转-ChipDebug

【FPGA图像处理实战】- RGB与HSV互转-ChipDebug

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FPGA常见问题

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等级-LV1-ChipDebug

3年前更新42次阅读

单独使用modelsim仿真xilinx

如何使用modelsim仿真xilinx 直接在modelsim软件内执行.do文件进行仿真，不通过vivado调用modelsim，vivado仅用于生成IP核。 1....

单独使用modelsim仿真xilinx-ChipDebug

单独使用modelsim仿真xilinx-ChipDebug

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等级-LV4-ChipDebug

3年前更新183次阅读

了解并缓解 Xilinx 7 系列器件中的系统级 ESD 和 EOS 事件

By: James Karp, Michael Hart, and Tc Chai
半导体行业的规模化趋势（称为“摩尔定律”）会导致集成电路组件级静电放电 (ESD) ...

了解并缓解 Xilinx 7 系列器件中的系统级 ESD 和 EOS 事件-ChipDebug

了解并缓解 Xilinx 7 系列器件中的系统级 ESD 和 EOS 事件-ChipDebug

了解并缓解 Xilinx 7 系列器件中的系统级 ESD 和 EOS 事件-ChipDebug

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等级-LV1-ChipDebug

3年前更新33次阅读

莱迪思不断快速扩展产品组合，开启下一个创新时代

全新推出莱迪思Avant-G和Avant-X中端FPGA、专用解决方案集合和软件更新
在今天的莱迪思开发者大会上，莱迪思半导体宣布继续扩展其产品线，推出了多款全新硬件和软件解决方案更新。莱迪思推出了两款基于屡获殊荣的莱迪思Avant™中端平台打造的全新创新中端FPGA...

Lattice-莱迪斯

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等级-LV3-ChipDebug

3年前发布28次阅读

分享个逻辑分析仪前端电路

分享个逻辑分析仪前端电路-ChipDebug

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