SOC FPGA论坛首页-ChipDebug-第474页

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在数字电路的设计中,时序设计是一个系统性能的主要标志,在高层次设计方法中, 对时序控制的抽象度也相应提高,因此在设计中较难把握,但在理解 RTL 电路时序模型的 基础上,采用合理的设计方法在设计复杂数字系统是行之有效的,通过许多设计实例证明采 用这种方式可以使电路的后仿真通过率大大提高,并且系统的工作频率可以达到一个较高水 平。
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NiosII 的开发环境提供了对符合 CFI 标准的 Flash 的支持,使用几个简单的函数,即 可以操作 Flash。本文介绍了 nios 中 flash 的使用。 关键词:EDA,Nios II,CFI 标准,Flash 在嵌入式系统中,Flash 是最常用组件之一。许多使用过 flash 的朋友都了解,Flash 的特点 是“读来容易写来难”。通常,可以直接读出 Flash 的内容;但如果要写入数据,就要发送一 长串命令,比如像:555 ,AA,2AA,55,555,A0 ,PA,PD 就表示对 PA 地址写入数据 PD,实际情况还要复杂一点,因为通常还要包含许多查询操作。 哎呀,这真是好繁琐呀,有没有省力的方法呢?现在好了,NiosII 的开发环境提供了对符合 CFI 标准的 Flash 的支持,使用几个简单的函数,就可以操作 Flash,真是方便了许多。 在这里,我粗略得介绍一下 nios 中 flash 的使用;更加详细的帮助信息请您参考 Altera 公司 提供的文档。如果本文能对您有一点点帮助,我都会感到非常高兴。
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