SOC FPGA论坛首页-ChipDebug-第1067页

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Xilinx FPGA AI开发工具AIE(5)—针对AI Engine进行编译

在上一篇文章中，我们介绍了针对x86处理器编译AIE并执行功能仿真。在本篇文章中，我们将介绍针对AI Engine模型编译AIE并执行仿真...

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Xilinx FPGA AI开发工具 AIE(3)—理解AIE编程中的Kernel

在上一篇文章中我们介绍了AIE中的graph。graph通常在一个.h文件中描述，可认为是AIE应用工程的顶层文件，位置仅次于仿真文件，我...

Xilinx FPGA AI开发工具 AIE(3)—理解AIE编程中的Kernel-ChipDebug

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https://chipdebug.com/forum-post/52660.html https://chipdebug.com/forum-post/52681.html

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Xilinx FPGA AI开发工具AIE(4)—AIE编译器和X86模拟器

在之前的文章中，我们介绍了如何在Vitis下创建一个AIE工程以及AIE工程中的graph和kernel等基本概念，回顾一下，我们可以看到AIE...

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Dell’Oro_Group发布报告：在这个优势领域，华为依旧是全球第一

10月8日市场研究公司Dell'Oro Group正式发布了2022年上半年全球电信设备市场报告，报告显示过去的上半年全球电信设备收入同比增...

Dell'Oro_Group发布报告：在这个优势领域，华为依旧是全球第一-ChipDebug

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美国全面限制中国芯片

10月8日，据外媒报道，美国商务部发布最新出口管制措施，将长江存储、中国科学院大学、上海理工大学等31家中国公司、机构列入所...

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苹果 A16 芯片或沿用 A15 设计

在今年发布的苹果 14 系列手机中，仅有 iPhone 14 Pro / Max 搭载了苹果 A16 芯片。虽然采用了台积电 4nm 工艺，但无论是 Geekbe...

苹果 A16 芯片或沿用 A15 设计-ChipDebug

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芯片卖不动了！AMD业绩大降

美国超微公司10月7日大幅下跌，以每股58.44美元收盘，跌幅达13.87%，创2020年7月以来最低水平。该半导体公司发布了第三季度的初...

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汽车芯片新“混战”

消费电子市场的疲软，给持续了近2年的“缺芯潮”按下了暂停键。
当前，市场已经从前期的全面缺芯，向结构性缺芯的态势转移，即以...

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PCIe扫盲——PCI总线基本概念

PCI是Peripheral Component Interconnect(外设部件互连标准)的缩写，它曾经是个人电脑中使用最为广泛的接口，几乎所有的主板产品...

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PCIe扫盲——一个典型的PCI总线周期

PCI总线是一种地址和数据复用的总线，即地址和数据占用同一组信号线AD。PCI总线的所有信号都与时钟信号同步，及所有的信号的变化...

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PCIe扫盲——PCI总线中的Reflected-Wave Signaling

PCIe PCI Spec规定了每个PCI总线上最多可以连接多达32个PCI设备，但是实际上却远远达不到32个，33MHz的32位PCI总线一般只能连接10到12...

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PCIe扫盲——PCI总线的三种传输模式

PCIe 本文来简单地介绍一下PCI Spec规定的三种数据传输模型：Programmed I/O（PIO），Peer-to-Peer和DMA。
三种数据传输模型的示意图...

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4年前更新24次阅读

PCIe扫盲——PCI总线的中断和错误处理

PCIe PCI总线使用INTA#、INTB#、INTC#和INTD#信号向处理器发出中断请求。这些中断请求信号为低电平有效，并与处理器的中断控制器连接...

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PCIe扫盲——PCI总线的地址空间分配

PCIe PCI总线具有32位数据/地址复用总线，所以其存储地址空间为2的32次方=4GB。也就是PCI上的所有设备共同映射到这4GB上，每个PCI设备...

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PCIe扫盲——PCI总线配置周期产生和配置寄存器

PCIe 上一篇文章中也是说到了，I/O Address Space的空间很有限（64KB），所以一般在I/O Space中都有两个寄存器，第一个指向要操作的内...

PCIe扫盲——PCI总线配置周期产生和配置寄存器-ChipDebug

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PCIe扫盲——66MHz的PCI总线与其技术瓶颈

PCIe 为了能够取得更高的带宽，新版本的PCI Spec将PCI总线提高到了64-bit并将频率提高到了66MHz，最高支持533MB/s。下图描述的是一个...

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PCIe扫盲——PCI-X总线基本概念

PCIe PCI-X总线在PCI总线的基础上发展而来，其在软件和硬件层面上都是兼容PCI总线的，但是却显著的提高了总线的性能。也就是说PCI-X的...

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PCIe扫盲——PCIe总线基本概念

PCIe PCIe总线的提出可以算是代表着传统并行总线向高速串行总线发展的时代的到来。实际上，不仅是PCI总线到PCIe总线，高速串行总线取...

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PCIe扫盲——PCIe总线体系结构入门

PCIe 和很多的串行传输协议一样，一个完整的PCIe体系结构包括应用层、事务层（Transaction Layer）、数据链路层（Data Link Layer）和...

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PCIe扫盲——PCIe总线事务层入门（一）

PCIe 在介绍事务层之前，首先简单地了解一下PCIe总线的通信机制。假设某个设备要对另一个设备进行读取数据的操作，首先这个设备（称之...

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PCIe扫盲——PCIe总线事务层入门（二）

PCIe 前面的文章介绍了TLP的几种类型以及TLP的包结构。这篇文章来详细地聊一聊Non-Posted Transaction（包括Ordinary Read、Locked Re...

PCIe扫盲——PCIe总线事务层入门（二）-ChipDebug

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PCIe扫盲——PCIe总线事务层入门（三）

PCIe PCIe总线设计之初，充分考虑到了音频和视频传输等这些对时间要求特别敏感的应用。为了保证这些特殊应用的数据包能够得到优先发送...

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PCIe扫盲——PCIe总线数据链路层入门

PCIe 前面的文章介绍过，数据链路层（Data Link Layer）主要进行链路管理（Link Management）、TLP错误检测，Flow Control和Link功耗...

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PCIe扫盲——PCIe总线物理层入门

PCIe 前面的文章简单的介绍了一些关于PCIe总线事务层（Transaction Layer）和数据链路层（Data Link Layer）的一些基本概念。这篇文...

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PCIe扫盲——一个Memory Read操作的例子

PCIe 前面的一系列文章简要地介绍了PCIe总线的结构、事务层、数据链路层和物理层。下面我们用一个简单地的例子来回顾并总结一下。
如...

PCIe扫盲——一个Memory Read操作的例子-ChipDebug

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PCIe扫盲——BDF与配置空间

PCIe 前面的文章中介绍过，每一个PCIe设备可以只有一个功能（Function），即Fun0。也可以拥有最多8个功能，即多功能设备（Multi-Fun）...

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PCIe扫盲——配置空间的读写机制

PCIe 需要特别注意的是，PCIe的Spec中明确规定只有Root有权限发起配置请求（Originate Configuration Requests），也就是说PCIe系统里...

PCIe扫盲——配置空间的读写机制-ChipDebug

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PCIe扫盲——Type0 Type1 型配置请求

PCIe 前面的文章中介绍过有两种类型的配置空间，Type0和Type1，分别对应非桥设备（Endpoint）和桥设备（Root和Switch端口中的P2P桥）...

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PCIe扫盲——Memory IO 地址空间

PCIe 早期的PC中，所有的IO设备（除了存储设备之外的设备）的内部存储或者寄存器都只能通过IO地址空间进行访问。但是这种方式局限性很...

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PCIe扫盲——基地址寄存器（BAR）详解

PCIe 基地址寄存器（BAR）在配置空间（Configuration Space）中的位置如下图所示：
其中Type0 Header最多有6个BAR，而Type1 Header最...

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