SOC FPGA论坛首页-ChipDebug-第22页

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3年前更新203次阅读

手把手教你在Xilinx FPGA上搭建一个ARM Cortex-M3软核

之前介绍了ARM DesignStart计划，其中提到了Cortex-M1/M3 DesignStart FPGA版本支持Xilinx和国产Gowin平台，本篇文章将手把手教...

手把手教你在Xilinx FPGA上搭建一个ARM Cortex-M3软核-ChipDebug

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3年前更新24次阅读

PCIe架构概述（二）

不用通用时钟如前所述，PCIe Link不需要通用时钟(Common Clock)，因为它使用源同步模型，这意味着发送器将时钟提供给接收器以...

PCIe架构概述（二）-ChipDebug

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FPGA常见问题

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7年前发布18次阅读

Virtex-6 FPGA连接功能套件TRD – DDR3无法初始化

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7年前发布19次阅读

仿真ACDS 13.1更新3设计时生成的VHDL错误“错误：未知正式标识符pll_slf_rst”和Verilog错误“错误：未解析的对pll_slf_rst的defparam引用”

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7年前发布984次阅读

13.2 Verilog $ clog2函数实现不正确

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2年前更新121次阅读

串行外设接口SPI基于VHDL代码（二）

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FPGA CPLD资料源码分享

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7年前发布46次阅读

为什么我会收到错误：“文本设计文件语法错误：文本设计文件包含’（’，但必须包含ASSERT，CONSTANT，DEFINE，DESIGN，FUNCTION，OPTIONS，PARAMETERS，SUBDESIGN或TITLE”？

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7年前发布37次阅读

Vivado – PROHIBIT约束影响report_utilization

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2年前更新68次阅读

xilinx FPGA上可以使用的UART 转 AXI 调试桥接verilog源码

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FPGA开源项目

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3年前更新353次阅读

面向硬件的设计思维——FPGA程序执行顺序

从一开始讲verilog的时候就已经多次给大家强调verilog是硬件描述语言。这次总结下面向硬件设计的思维，包括硬件设计模式，程序执...

面向硬件的设计思维——FPGA程序执行顺序-ChipDebug

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7年前发布183次阅读

Xilinx配置解决方案中心-配置文档

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7年前发布11次阅读

8.1project navigator -FATAL_ERROR：GuiUtilities：Gq_Application.c：570：1.12.10.2

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3年前发布56次阅读

为什么平台上没有讨论紫光的FPGA

想问下各位为什么平台上没有讨论紫光的FPGA

Pangomicro紫光同创

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7年前发布75次阅读

7系列MIG DDR3 SDRAM – 高范围（HR）存储区中是否需要DQ和DQS上的外部端接？

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7年前发布56次阅读

如何在Quartus II 14.1中启用HPS用户时钟2？

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3年前更新32次阅读

已解决modelsim 仿真报错Failed to find ‘video_cap_new’ in hierarchical name ‘video_cap…

modelsim仿真报错,自带的Isim却通过了仔细查也没法发现问题在哪?调用一个参数，说找不到？

FPGA常见问题

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3年前更新35次阅读

已解决在FPGA上移植 risc V和cortex m0 哪个资源消耗的多啊?

在FPGA上移植 risc V和cortex m0 哪个资源消耗的多啊, 有没有做过的

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3年前发布79次阅读

提问pynq z2使用spi slave模式相關問題

目前pynq z2使用spi的slave模式，但在跟dsp溝通的時候會有問題。我們原先猜測是會多一個0在最前面，像是我原先要傳 1111111111111111 結果會變成 0111111111111111，多的1會被推到下一列，試著手動全部往前推一位後仍然會一些有錯誤，不知道這個問題是甚麼導...

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3年前更新141次阅读

基于EF2S45VG81C的MIPI方案(一）

最近在用安路的器件调一个案子，输入分辨率1280*1728@60(4lane)，输出分辨率1600*2160@(8lane)。需要用cpld来做一个升阶。cpld部...

基于EF2S45VG81C的MIPI方案(一）-ChipDebug

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3年前更新67次阅读

寻找在武汉的精通FPGA的信号处理专家合作。

如题。朋友公司找合伙人，要求人在武汉，有意者请联系，或者帮忙推荐，感谢！

FPGA招聘信息

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7年前发布22次阅读

CoolRunner II：时钟分频器复位引脚（CDRST）的行为

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7年前发布19次阅读

Virtex-4 – Virtex-4在SelectMAP8中正确配置，但在SelectMAP32中未正确配置

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7年前发布7次阅读

LogiCORE IP SMPTE2022-5 / 6视频IP传输器v2.0 – SMPTE2022-5 / 6内核是否支持IPv6？

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3年前更新37次阅读

FPGA 编程三大范例

注释：本文节选自赛灵思《Vitis 高层次综合用户指南 (UG1399)》v2021.2，仅作为个人学习记录之用，侵删。
虽然 FPGA 可使用 Ve...

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3年前更新374次阅读

已解决lattice diamond SynplifyPro 编译错误 “Can’t open input file”

在lattice diamond软件编译参考设计时出现如下错误，对参考设计没做任何修改，综合工具选的是SynplifyPro，上周还可以没有问题,大伙能帮忙看看吗？ERROR - NF100 |Can’t open input file F:\dsirxreferencedesignrgb8882lane\rd1185_mipi_dsi2parallel_bridg...

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超级版主1

用synplify打开看看。参考这个提问，https://chipdebug.com/forum-post/449.html

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3年前更新49次阅读

mipi_DSI-2_specification_v1-0.pdf

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FPGA CPLD资料源码分享

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7年前发布18次阅读

错误（175006）：时钟树和目标UFIND4H_UIB之间没有路由连接

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3年前更新667次阅读

全网最详细Lattice ddr3教程之仿真和时序约束全攻略

Lattice ddr3教程全攻略之仿真篇对于这部分，首先建议安装好diamond,modelsim se 10.1a这两个软件，如果想仔细分析DDR3的IP部分...

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7年前发布175次阅读

对Lattice MIPI DSI TX RD1184参考设计中dcs_rom模块的疑惑

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Lattice-莱迪斯

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3年前更新174次阅读

已解决LATTICE ECP5 FPGA DDR3 MEM 如何仿真？

LATTICE ECP5 FPGA DDR3 MEM 如何使用MODELSIM仿真？

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首先目录下的inst1_eval.do文件

注意下面的路径以及diamond的版本改为你自己的

然后启动modelsim键入以下命令进入仿真所在目录，注意替换成你对应的目录

然后键入以下命令运行仿真

可以看到仿真波形以及输出的调试信息

Lattice-莱迪斯

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