SOC FPGA论坛首页-ChipDebug-第2页

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等级-LV3-ChipDebug

1年前更新91次阅读

VCS+Verdi和Xrun+Indago简单仿真环境搭建

导言本期主要给大家出一个简单makefile+tcl的仿真环境，支持vcs+verdi以及xrun+indago，因为最近虚拟机中的vcs不稳定，所有把...

VCS+Verdi和Xrun+Indago简单仿真环境搭建-ChipDebug

VCS+Verdi和Xrun+Indago简单仿真环境搭建-ChipDebug

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等级-LV1-ChipDebug

1年前更新249次阅读

分享一份EDA虚拟机环境变量设置（仅供学习参考）

0.前言EDA环境变量的设置可以说是芯片验证工程师的一项基本功，环顾四周，发现身边依然有不少小伙伴对EDA环境变量的设置并不是很...

分享一份EDA虚拟机环境变量设置（仅供学习参考）-ChipDebug

FPGA常见问题

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等级-LV1-ChipDebug

7个月前发布140次阅读

提问reveal inserter使用异常问题

it文件绝对烧录进板子了，但是使用reveal 时。debug device：已经搜索到了，就是没办法选择。提示：please check cable connect...

reveal inserter使用异常问题-ChipDebug

reveal inserter使用异常问题-ChipDebug

Lattice-莱迪斯

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等级-LV1-ChipDebug

2年前更新107次阅读

赛灵思的DDR IP手册ug586翻译和学习（2）第二章 AXI4 slave interface block AXI4从设备接口模块

赛灵思公司（Xilinx）的手册UG586：zynq-7000 AP Soc and 7 Series Devices Memory Interface Solutions，介绍的是DDR的IP核相关使用知识。我的阅读从第一章DDR3 and DDR2 SDRAM Memory Interface开始。继续上一篇，翻译和学习的是AXI4 Slave Interface Block...

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等级-LV1-ChipDebug

2年前更新29次阅读

赛灵思的DDR IP手册ug586翻译和学习（1）第一章 User interface block UI模块

赛灵思公司（Xilinx）的手册UG586：zynq-7000 AP Soc and 7 Series Devices Memory Interface Solutions，介绍的是DDR的IP核相关...

赛灵思的DDR IP手册ug586翻译和学习（1）第一章 User interface block UI模块-ChipDebug

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等级-LV2-ChipDebug

2年前更新122次阅读

Data2Mem使用和调试指南

描述此答复记录提供可下载的Data2Mem使用和调试指南PDF以增强其可用性。答案记录是基于Web的内容，在新信息可用时经常更新。要获取最新版本的PDF，请访问此答复记录。解本文档通过示例逐步说明如何使用Data2Mem。它描述了如何编写BMM文件，如何检查BIT文...

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等级-LV1-ChipDebug

9个月前发布89次阅读

曾经的我与FPGA

曾经高速数字信号处理，曾经光纤、DDR、PCIE DMA，变频、各类算法，曾经一个多小时的工程编译等待

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等级-LV3-ChipDebug

2年前更新3747次阅读

精MCU模拟JTAG接口对LATTICE CPLD进行在线编程加载

作者：Rock.Ding（莱迪思半导体公司）关键字：MCU, JTAG, 在线编程, CPLD。前言CPLD(Complex Programmable Logic Device)复杂可...

MCU模拟JTAG接口对LATTICE CPLD进行在线编程加载-ChipDebug

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2年前更新644次阅读

如何用DSP模拟lattice的JTAG下载程序？

我现有一块DSP+CPLD的板子，DSP是28335，cpld是lattice的LAMXO640。CPLD的JTAG端口直接连接到了DSP的GPIO，并且JTAG没有预留出来...

如何用DSP模拟lattice的JTAG下载程序？-ChipDebug

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Lattice-莱迪斯

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等级-LV1-ChipDebug

1个月前发布33次阅读

已解决ELF2使用AST硬核时报错SYN-8207

AST硬核在空闲的时候默认会发送K码，我想让他在空闲的时候不发送K码，所以想用一个与门将AST的ast_tx在空闲时设置为高，但是会报错，提示ast_tx没有连接到引脚，感觉像不允许操作这个IP核的输出，我想问问有没有什么办法能让AST在空闲的时候不发送K码。

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等级-LV3-ChipDebug

2年前更新3272次阅读

精为什么verilog 仿真输出都是红线

经常有学习Verilog的新人问我：为什么我仿真的时候发现所有的模块输出都是红线？一开始我都还是不厌其烦地帮助大家一点点分析代码，因为红线在仿真器中代表不确定态，而不确定态的成因是多种多样的。但是看过了无数新人案例后我发现，其实新人出现这种问题的...

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2年前发布33次阅读

2048点FFT verilog 源码

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FPGA CPLD资料源码分享

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等级-LV1-ChipDebug

26天前发布17次阅读

把fpga模拟成其它硬件的学习路径？

需要学习多少小时可以出师？

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等级-LV2-ChipDebug

2年前更新2877次阅读

精FPGA通过MII RGMII接口进行UDP以太网数据通信的教程分享

FPGA RGMII GMII MII接口以太网通讯之以太网简介以太网是一种产生较早，使用相当广泛的局域网。其最初是由Xerox（施乐）公司创建...

FPGA通过MII RGMII接口进行UDP以太网数据通信的教程分享-ChipDebug

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等级-LV1-ChipDebug

6年前发布231次阅读

LATTICE FPGA综合参数时报警告 unsupported property怎么解决？

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Lattice-莱迪斯

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等级-LV2-ChipDebug

2年前更新80次阅读

易灵思开发工具IDE软件下载

易灵思的东西挺小众，自己玩玩可以，做产品的话还是三思。废话不多说，直接上网盘：

易灵思(Elitestek)

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等级-LV3-ChipDebug

10个月前更新318次阅读

ICMaker 的 LATTICE HW-USBN-2B 下载器软件使用教程（工具资料免费下载）

Lattice下载器高速编程器HW-USBN-2B fpga仿真器ispdown烧录器https://item.taobao.com/item.htm?id=707423326820 JTAG速度支持30...

ICMaker 的 LATTICE HW-USBN-2B 下载器软件使用教程（工具资料免费下载）-ChipDebug

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Lattice-莱迪斯

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亿灵思软件使用指南（一）软件安装

本视频介绍了 Windows 系统下亿灵思软件的安装过程和注意事项，以及 Licence文件的导入过程，指导开发人员快速完成软件安装和软件注册。链接：https://pan.baidu.com/s/1EFipn_hpOzO3_OX69iE7aw提取码：1111elinx安装包Licence文件私信申请

中科亿海微(ehiway)

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31天前更新20次阅读

已解决刚下载的软件小白打开工程文件报错，这哪出问题了

刚下载的软件小白打开工程文件报错，这哪出问题了-ChipDebug

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1个月前发布30次阅读

已解决请问我使用TD5.6.2打开安路工程显示器件未知，应该如何解决，如何添加器件包

我使用TD5.6.2打开安路工程显示器件未知，应该如何解决，如何添加器件包

请问我使用TD5.6.2打开安路工程显示器件未知，应该如何解决，如何添加器件包-ChipDebug

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50天前发布95次阅读

已解决关于MCU模拟JTAG下载aje格式文件失败问题

PCIe 一、AJE2JTAG文档CLK时序描述1、1.6.2.2 延时校准章节描述该章节描述TCK进行校验，开启RUNTEST_CALIBRATION后，是为了验证Anl...

关于MCU模拟JTAG下载aje格式文件失败问题-ChipDebug

关于MCU模拟JTAG下载aje格式文件失败问题-ChipDebug

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关于MCU模拟JTAG下载aje格式文件失败问题-ChipDebug

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等级-LV2-ChipDebug

6年前发布13次阅读

7.1i xST -“错误：xST：1490 -实例化的LUT4在单位中没有任何init属性“

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1个月前更新81次阅读

提问大模型在FPGA上做加速

请问一下我想在FPGA上部署大模型，然后进行加速设计。应该怎么做啊，小白求助

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等级-LV3-ChipDebug

7个月前更新130次阅读

PotatoPie V4.0 入门教程(10)——python绿色版环境搭建

python安装及pip依赖包安装已做好的免安装版为了充分体现前面所说的python的简便性，如果不想进行python安装，我们提供已做好的p...

PotatoPie V4.0 入门教程(10)——python绿色版环境搭建-ChipDebug

PotatoPie V4.0 入门教程(10)——python绿色版环境搭建-ChipDebug

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1年前更新47次阅读

安路TangDynasty(TD)快速验证管脚好坏或焊接是否异常的工具I/O State Editor

这个功能其实就是是JTAG的边界扫描功能，可以用来快速判断管脚本身的好坏。
I/O State Editor 工具可以通过 JTAG 边界扫描指...

安路TangDynasty(TD)快速验证管脚好坏或焊接是否异常的工具I/O State Editor-ChipDebug

安路TangDynasty(TD)快速验证管脚好坏或焊接是否异常的工具I/O State Editor-ChipDebug

安路TangDynasty(TD)快速验证管脚好坏或焊接是否异常的工具I/O State Editor-ChipDebug

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安路TangDynasty(TD)快速验证管脚好坏或焊接是否异常的工具I/O State Editor-ChipDebug

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1年前更新1805次阅读

Synopsys2020及以上版本安装方法

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1年前更新41次阅读

Vivado、Modelsim、Matlab软件下载

vivado、modelsim、matlab等开发软件。为方便大家下载，现将百度网盘连接附录如下：Vivado2018.3:链接：https://pan.baidu.com/s/1R1U43H95sCoOGkZwvChYowMatlab R2022b( Win-64):链接：https://pan.baidu.com/s/1z9qfPpmpDcf3yDnyyqwn-AModelsim10.6d-se:链...

FPGA CPLD资料源码分享

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等级-LV1-ChipDebug

42天前发布7次阅读

GAL系列产品编程器

Lattice公司的GAL系列产品芯片的编程器是什么型号？

Lattice-莱迪斯

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等级-LV2-ChipDebug

7年前发布972次阅读

ddr3 存储器的 on the fly 是什么意思？

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Lattice-莱迪斯

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等级-LV1-ChipDebug

44天前发布8次阅读

已解决实例33图像叠加例化后报错

实例33图像叠加例化后报错，工程中找不到emb32，但是将图2图像叠加功能输出部分注释后报错消失，请问这是什么原因报错，怎么解决...

实例33图像叠加例化后报错-ChipDebug

实例33图像叠加例化后报错-ChipDebug

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