SOC FPGA论坛首页-ChipDebug-第53页

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4年前更新104次阅读

集成电路设计基础时序电路篇（一）

导言：
今天开个专题：CMOS VLSI Design，关于IC设计的书，之前推荐大家看过，我猜测很多人英文都很难看下去，所以花点时间翻译...

集成电路设计基础时序电路篇（一）-ChipDebug

集成电路设计基础时序电路篇（一）-ChipDebug

集成电路设计基础时序电路篇（一）-ChipDebug

集成电路设计基础时序电路篇（一）-ChipDebug

FPGA常见问题

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3年前更新71次阅读

AXI4协议逻辑规范以及BUG处理

1AXI 握手协议规范以及BUG处理简介列举AXI应该遵循的逻辑规范以及一些逻辑BUG，即使是赛林丝官方的代码也要注意。规则AXI所需要...

AXI4协议逻辑规范以及BUG处理-ChipDebug

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4年前更新191次阅读

FPGA/IC优质开源项目（三）AXI

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FPGA开源项目

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4年前更新138次阅读

FPGA/IC优质开源项目（五）CPU

本期开源项目主要为一些处理器，里面有相当的项目代码值得参考。ZipCPUZip CPU 是一种体积小、重量轻的 RISC CPU,具体设计目标包括：32 位。所有寄存器、地址和指令的长度都是 32 位。虽然字节大小本身曾经是 32 位，但 CPU 现在像所有其他 CPU 一样处理 8 ...

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4年前更新557次阅读

FPGA/IC优质开源项目（六）PCIe

LitePCIe
LitePCIe 提供小尺寸和可配置的 PCIe 内核。（非Verilog代码，是个库，想了解的可以稍微了解一下）
LitePCIe 是 LiteX 库的一部分，其目标是通过提供当今 SoC 中使用的组件（如以太网、SATA、PCIe、SDRAM 控制器...）
使用 Migen 描述 HDL 允许内核...

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4年前更新136次阅读

如何设计逐次逼近型ADC驱动电路

文章来自德州仪器官网
作者：Jenson Fang
逐次逼近型（SAR）ADC是在在工业，汽车，通讯行业中应用最广泛的ADC之一，例如电机电流...

如何设计逐次逼近型ADC驱动电路-ChipDebug

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3年前更新69次阅读

跨时钟域的几种基本处理方法

导言在很久之前便陆续谈过亚稳态，FIFO，复位的设计。本次亦安做一个简单的总结，从宏观上给大家展示跨时钟域的解决方案。什么是...

跨时钟域的几种基本处理方法-ChipDebug

跨时钟域的几种基本处理方法-ChipDebug

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3年前更新93次阅读

【手把手系列】：芯片设计中的Makefile简明教程

Makefile可以做什么？ Makefile可以根据指定的依赖规则和文件是否有修改来执行命令。常用来编译软件源代码，只需要重新编译修改过的文件，使得编译速度大大加快。 Makefile的基本格式目标：依赖命令目标是要生成的结果，依赖是生成结果需要的源文...

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4年前更新918次阅读

如何通过makefile实现Vivado自动化编译

导言
今天主要介绍通过配置Cygwin（在win环境执行makefile）和Vscode中实现Vivado从建立工程，综合，实现，生成bit，下载等一系...

如何通过makefile实现Vivado自动化编译-ChipDebug

如何通过makefile实现Vivado自动化编译-ChipDebug

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4年前更新153次阅读

【知识干货】The UVM Primer | 快速入门UVM 第二十三章 UVM Sequence

用于介绍UVM入门的最佳用书，形象介绍了UVM必要的组件，并结合简单的实验进行实现。非常基础，适合没有UVM基础的人快速入门从UVM...

【知识干货】The UVM Primer | 快速入门UVM 第二十三章 UVM Sequence-ChipDebug

【知识干货】The UVM Primer | 快速入门UVM 第二十三章 UVM Sequence-ChipDebug

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4年前更新133次阅读

AXI4/AXI5-Stream协议介绍

AXI4-Stream简介
AXI4-Stream概念简介
AXI4-Stream是一种标准协议接口，可用于芯片内部的数据流传输，不同于内存数据传输相关协...

AXI4/AXI5-Stream协议介绍-ChipDebug

AXI4/AXI5-Stream协议介绍-ChipDebug

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4年前更新32次阅读

FPGA/IC优质开源项目（七）综合

导言
开源项目推荐已经有六期了，已经发了AXI，PCIe，以太网，低速接口等等，大家可以从往期文章阅读。本期主要带来VHDL的开源项...

FPGA/IC优质开源项目（七）综合-ChipDebug

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AXI4/AXI5-Stream协议介绍

AXI4-Stream简介
AXI4-Stream概念简介
AXI4-Stream是一种标准协议接口，可用于芯片内部的数据流传输，不同于内存数据传输相关协...

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1年前更新2132次阅读

EDA仿真调试软件VCS2020和Verdi2020下载分享

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4年前更新219次阅读

Windows Subsystem for Linux运行Ubuntu并安装Synopsys软件

Windows Subsystem for Linux运行EDA软件
导言
大家用什么方式来运行Linux？安装各种EDA安装包呢？常见的可能是双系统、虚拟机、...

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Ubuntu运行VCS+Verdi问题补充

导言给大家分享了Ubuntu的备份包，里面安装了VCS2018，VCS_MAX2018，Verdi2018,以及DC2018，便于大家学习，但有几个问题需要补充...

Ubuntu运行VCS+Verdi问题补充-ChipDebug

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4年前更新655次阅读

FPGA/IC优质开源项目（三）AXI

浠婂ぉ涓昏浠嬬粛AXI鐨勫紑婧愰」鐩?1Alexforencich鐨凙XI
浠嬬粛
涓昏鍖呭惈AXI-lite锛孉XI锛屽寘鍚玞rossbar浠ュ強interconnect绛夛紝瀹屾垚搴﹂潪甯搁珮锛岃瑷€涓篤erilog銆備富瑕佹枃浠朵互鍙婁粨搴撳湴鍧€濡備笅锛?rtl/arbiter.v聽聽聽聽聽聽聽...

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4年前更新87次阅读

AXI4/AXI5-Stream协议介绍

AXI4-Stream简介
AXI4-Stream概念简介
AXI4-Stream是一种标准协议接口，可用于芯片内部的数据流传输，不同于内存数据传输相关协...

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4年前更新181次阅读

AXI-Stream代码测试（alexforencich）

导言之前给大家介绍过alex的开源项目，现在开始陆续出教程，本期主要介绍最常见的AXIS，关于AXI-Stream的概念性教程。AXIS异步FI...

AXI-Stream代码测试（alexforencich）-ChipDebug

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4年前更新202次阅读

以太网（UDP）开源Verilog专题（一）

导言
之前就说过要出Alexforencich以太网开源代码教程，与其说是教程不如说是笔记，本次专题多篇发送，本篇主要记录一些基础知识...

以太网（UDP）开源Verilog专题（一）-ChipDebug

以太网（UDP）开源Verilog专题（一）-ChipDebug

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4年前更新394次阅读

FPGA/IC优质开源项目（八）MIPI

导言：
本篇主要推荐关于mipi协议的开源项目，mipi常见的协议有DSI，CSI，I3C等。本篇将分别介绍相关的开源代码。
DSI
仓库地址...

FPGA/IC优质开源项目（八）MIPI-ChipDebug

FPGA/IC优质开源项目（八）MIPI-ChipDebug

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4年前更新259次阅读

FPGA/IC优质网站以及开源仓库推荐

本期给大家带来一些优质网站和开源仓库，便于大家快速寻找到先要的资料。
代码怎么找？
Github
一些大厂的开源代码基本都在githu...

FPGA/IC优质网站以及开源仓库推荐-ChipDebug

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4年前更新46次阅读

FPGA/IC优质开源项目（九）RISC

导言
本期主要给大家带来优秀的risc的处理器，前面推荐过几个比如阿里的开源cpu以及zipcpu，大家可以到开源集合中查看，本次推荐...

FPGA/IC优质开源项目（九）RISC-ChipDebug

FPGA/IC优质开源项目（九）RISC-ChipDebug

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4年前更新334次阅读

平头哥开源RISC-V处理器C910仿真

导言
最近花了点时间用VCS仿真了一下平头哥的开源RISC-V架构CPU，跑了几个case，但还没有时间去研究，仅仅是跑了一下，因为官方...

平头哥开源RISC-V处理器C910仿真-ChipDebug

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1年前更新376次阅读

Vivado2022.2更新，新特性值得关注

1导言Vivado2022.2终于发布，本次比较有意思的更新为IP配置文件由XML修改为JSON以及安装的磁盘空间占用大幅度减小，安装常用的器...

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4年前更新54次阅读

Verilog阻塞与非阻塞赋值详解

导言
关于Verilog阻塞与非阻塞的问题，非常多的教程给出了解释，但大多仅给出一些关于阻塞非阻塞的设计原则，没有更加详细的讲解...

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4年前更新42次阅读

FPGA设计的8大重要知识点，你都get了吗？

1. 面积与速度的平衡与互换这里的面积指一个设计消耗FPGA/CPLD的逻辑资源的数量，对于FPGA可以用消耗的FF（触发器）和LUT（查...

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4年前更新155次阅读

FPGA布线拥塞主要原因及解决方法

在FPGA开发设计中，我们可能会经历由于资源占用过高的情况，例如BRAM、LUT和URAM等关键资源利用率达到或超过80%，此时出现时序违...

FPGA布线拥塞主要原因及解决方法-ChipDebug

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4年前更新93次阅读

深度学习FPGA实现数据计算

一、前言FPGA以擅长高速并行数据处理而闻名，从有线/无线通信到图像处理中各种DSP算法，再到现今火爆的AI应用，都离不开卷积、滤...

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4年前更新18次阅读

FPGA学习经验总结

在学习一门技术之前我们往往从它的编程语言入手，比如学习单片机时，我们往往从汇编或者C语言入门。所以不少开始接触FPGA的开发人员，往往是从VHDL或者Verilog开始入手学习的。但我个人认为，若能先结合《数字电路基础》系统学习各种74系列逻辑电路，深刻理解...

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