SOC FPGA论坛首页-ChipDebug-第12页

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XL_易灵思FPGA

等级-LV2-ChipDebug

8个月前更新157次阅读

RiscV的modelsim仿真

易灵思为每个IP提供了仿真脚本，另外由于所有的仿真模型都是由硬件语言实现的，所以不需要添加库文件。这里我们以相对复杂的sapp...

RiscV的modelsim仿真-ChipDebug

RiscV的modelsim仿真-ChipDebug

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易灵思(Elitestek)

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等级-LV2-ChipDebug

8个月前更新161次阅读

gtkwave界面每次都更新太麻烦？来个小技巧

迄今为止，大家都在吐槽gtkwave debug每次弹窗都会覆盖上一次弹窗设置好的排序和参数。下面我们分享一个可以暂时规避该问题的方...

gtkwave界面每次都更新太麻烦？来个小技巧-ChipDebug

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XL_易灵思FPGA

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8个月前更新65次阅读

易灵思Efintiy软件2023.2版本及其补丁

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XL_易灵思FPGA

等级-LV2-ChipDebug

8个月前发布16次阅读

软件打补丁报错

124/03/14 13:48:2 错误5(0x00000005)正在给目标目录添加时间戳 D:\Efinity\2023.1\pt\doc绝访问。024/03/14 13:48:42 错误5(0x00000005)正在给目标目录添加时间戳亚:\Efinity\2023.1\pt\03/14 13:48:42 错误 5(0x00000005)正在复制文件 D:\soft\efinity.oftl...

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等级-LV1-ChipDebug

8个月前更新12次阅读

已解决3.0板驱动问题

版主我之前买过2.0，可以发现驱动，但是我新买的3.0的板子插上后没有发现驱动，这是怎么回事呢？

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XL_易灵思FPGA

等级-LV2-ChipDebug

8个月前更新308次阅读

精易灵思下载器使用说明

目录一、硬件说明... 3二、特性... 3三、管脚说明... 4四、驱动安装... 4方法一：... 4方法二：... 7五、JTAG与UART共用... 8 ...

易灵思下载器使用说明-ChipDebug

易灵思下载器使用说明-ChipDebug

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XL_易灵思FPGA

等级-LV2-ChipDebug

4个月前更新7次阅读

undefined reference to `trap’

D:\Onboard_tranning\DDR3_Controller_V17_ti60_soc_v1\par\ddr_demo_ti60\embedded_sw\sapphire_soc\software\standalone\gpioD...

undefined reference to `trap'-ChipDebug

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XL_易灵思FPGA

等级-LV2-ChipDebug

8个月前发布13次阅读

undefined reference to `bsp_printf_full’

c:/efinity/efinity-riscv-ide-2023.2/toolchain/bin/../lib/gcc/riscv-none-embed/8.3.0/../../../../riscv-none-embed/bin/ld.exe: D:\FPGA_Prj\03_Ti60F225_DemoBoard\Prj_demo\02_Ti60F225_SoftDdr3_demo\Ti60F225_DDR3_Example\DDR3_Controller_V17_ti60...

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XL_易灵思FPGA

等级-LV2-ChipDebug

3个月前更新50次阅读

Error: Can’t communicate with the CPU

RISCV debug报错Open On-Chip Debugger 0.11.0+dev-04034-gfaf2fc486-dirty (2023-05-02-16:04)
Licensed under GNU GPL v2
For ...

Error: Can't communicate with the CPU-ChipDebug

易灵思(Elitestek)

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等级-LV1-ChipDebug

8个月前发布55次阅读

有偿求助解决一个fpga项目

本人小白研究生要做fpga，主要包括稳压信号的产生，信号的采集，a/d等方面，组内没人会，只能自学，有没有大佬有偿帮忙解决项目，可以加个联系方式先交流一下

FPGA常见问题

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等级-LV3-ChipDebug

8个月前更新100次阅读

OV5640 PCLK计算方法

OV5640 数据手册2.5节中system clock control一节中给出了其内部PLL的配置框图，从图中可以看出，PCLK的频率与以下几个寄存器有...

OV5640 PCLK计算方法-ChipDebug

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等级-LV3-ChipDebug

8个月前更新12次阅读

SOC 开发常用命令汇总

linux配IPifconfig eth0 192.168.100.100 netmask 255.255.255.128 up[root@linux ~]# ifconfig {interface} {up|down} <== 观察与启动接口
[root@linux ~]# ifconfig interface {options} <== 设置与修改接口
参数：
Interface，网卡接口代号，包括 et...

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等级-LV3-ChipDebug

8个月前更新7次阅读

PCB包地探讨

网络上找来三篇文章，简要概括包地要点：对于高速信号要么不包，包就好好包，怎么好好包？孔离铜皮尽可能近（但要破坏阻抗），包...

PCB包地探讨-ChipDebug

PCB包地探讨-ChipDebug

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等级-LV2-ChipDebug

8个月前发布10次阅读

LATTIEC Radiant 调试ddr3时，错误：error does not support Ip Evaluation

需要在strategy1里选bitstream选项，勾选ip evaluation,如下图所示：

LATTIEC Radiant 调试ddr3时，错误：error does not support Ip Evaluation-ChipDebug

LATTIEC Radiant 调试ddr3时，错误：error does not support Ip Evaluation-ChipDebug

Lattice-莱迪斯

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毛毛是只好汪

等级-LV1-ChipDebug

8个月前发布17次阅读

提问上板测试问题，新人请教

黑金XC7Z020B的板子将bit文件（功能是设置LED4闪烁）下到板子里后，LED4正常闪烁，为什么led1~led3都是微亮啊？我下载uart发送...

上板测试问题，新人请教-ChipDebug

上板测试问题，新人请教-ChipDebug

FPGA常见问题

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等级-LV2-ChipDebug

8个月前发布7次阅读

验证平台文档（SystemVerilog与功能验证、SystemVerilog验证–测试平台编写指南）

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等级-LV2-ChipDebug

8个月前发布7次阅读

激光雷达之基于ADC采集的机械旋转式激光雷达fpga部分设计（三）adc接收以及检波

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等级-LV2-ChipDebug

6个月前更新63次阅读

Lattice_DDR存储器设计规则(ecp系列)

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Lattice-莱迪斯

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毛毛是只好汪

等级-LV1-ChipDebug

8个月前更新72次阅读

已解决初学者求教7Z020 UART通信不正常

黑金XC7Z020B的板子将bit文件（功能是设置LED4闪烁）下到板子里后，LED4正常闪烁，为什么led1~led3都是微亮啊？我下载uart发送模...

初学者求教7Z020 UART通信不正常-ChipDebug

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等级-LV2-ChipDebug

8个月前更新12次阅读

激光雷达之基于ADC采集的机械旋转式激光雷达fpga部分设计（二）激光开关和功率调节控制

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等级-LV1-ChipDebug

8个月前发布78次阅读

提问请教下大家xilinx量产的话，芯片怎批量烧录程序？

如题，有个产品用到xilinx芯片，现在量产的话，工厂怎批量烧录程序，谢谢了

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等级-LV3-ChipDebug

8个月前更新20次阅读

HDMI接口的PCB设计详细规范

ICMaker最近发的几篇HDMI PCB帖子不错，我也转发一篇 4.1.1 HDMI接口的定义高清晰度多媒体接口（英文：High Definition Multime...

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等级-LV2-ChipDebug

8个月前发布27次阅读

emmc总线协议

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等级-LV3-ChipDebug

8个月前发布29次阅读

altium designer 使用Interactive HTML BOM生成网面版PCB图

PotatoPie V4.0的PCB由于部分区域的元件太挤，就没显示元件丝印，但是部分用户可能需要这信元件丝印信息，那么如何给用户交付动...

altium designer 使用Interactive HTML BOM生成网面版PCB图-ChipDebug

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等级-LV3-ChipDebug

7个月前更新176次阅读

PotatoPie 4.0开发板视频图像处理+RISC-V设计资料汇总帖（更新至2023/03/29）

资料转移至这个链接更新https://chipdebug.com/forum-post/54896.htmlPotatoPie 4.0 视频图像处理+RISCV设计板已发布！此帖将作...

PotatoPie 4.0开发板视频图像处理+RISC-V设计资料汇总帖（更新至2023/03/29）-ChipDebug

PotatoPie 4.0开发板视频图像处理+RISC-V设计资料汇总帖（更新至2023/03/29）-ChipDebug

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等级-LV1-ChipDebug

8个月前发布21次阅读

ip核DSP做除法运算

版主你好我可以用板载ip的dsp做除法运算吗？直接在软件上用除法太占资源了，报错9009

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等级-LV3-ChipDebug

8个月前更新17次阅读

HMDI 1.4 pcb布线指南

机翻ADI官网文档，仅供参考，原文https://ez.analog.com/video/w/documents/687/hdmi-layout-guideline 介绍此常见问题解答提供...

HMDI 1.4 pcb布线指南-ChipDebug

HMDI 1.4 pcb布线指南-ChipDebug

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等级-LV3-ChipDebug

8个月前更新33次阅读

Altium Designer 高速PCB设计HDMI特性阻抗设计方法

再来一篇HDMI PCB布线指导，文字不多，但其中的布线示图有参考意义。1 HDMI 布线注意事项1、差分对间距优先设置为9mil或11mil，...

Altium Designer 高速PCB设计HDMI特性阻抗设计方法-ChipDebug

Altium Designer 高速PCB设计HDMI特性阻抗设计方法-ChipDebug

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XL_易灵思FPGA

等级-LV2-ChipDebug

8个月前更新84次阅读

No serial flash detected, aborting flash programming

现象：通过Jtag bridge 烧写flash时提示 “No serial flash detected, aborting flash programming” 。结论: 2023.2及之前的版...

No serial flash detected, aborting flash programming-ChipDebug

易灵思(Elitestek)

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等级-LV3-ChipDebug

8个月前更新7次阅读

HDMI接口的PCB布局布线要求

再转载一篇关于HDMI PCB布线的文章高清多媒体接口（High Definition Multimedia Interface），简称：HDMI，是一种全数字化视频和...

HDMI接口的PCB布局布线要求-ChipDebug

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